📄 cc2420interface.tan.rpt
字号:
; N/A ; 53.50 MHz ( period = 18.690 ns ) ; fifo_w_delay_count[6] ; ram_addr_buf[2] ; mainclk ; mainclk ; None ; None ; 15.394 ns ;
; N/A ; 53.52 MHz ( period = 18.686 ns ) ; fifo_w_count[5] ; next_state.fifo_w_st3 ; mainclk ; mainclk ; None ; None ; 6.197 ns ;
; N/A ; 53.52 MHz ( period = 18.683 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[8] ; mainclk ; mainclk ; None ; None ; 15.387 ns ;
; N/A ; 53.57 MHz ( period = 18.667 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[10] ; mainclk ; mainclk ; None ; None ; 15.375 ns ;
; N/A ; 53.61 MHz ( period = 18.653 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[9] ; mainclk ; mainclk ; None ; None ; 15.365 ns ;
; N/A ; 53.67 MHz ( period = 18.632 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[7] ; mainclk ; mainclk ; None ; None ; 15.336 ns ;
; N/A ; 53.70 MHz ( period = 18.622 ns ) ; fifo_w_delay_count[6] ; ram_addr_buf[4] ; mainclk ; mainclk ; None ; None ; 15.334 ns ;
; N/A ; 53.80 MHz ( period = 18.588 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[3] ; mainclk ; mainclk ; None ; None ; 15.290 ns ;
; N/A ; 53.80 MHz ( period = 18.586 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[11] ; mainclk ; mainclk ; None ; None ; 15.297 ns ;
; N/A ; 54.10 MHz ( period = 18.484 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[6] ; mainclk ; mainclk ; None ; None ; 15.195 ns ;
; N/A ; 54.12 MHz ( period = 18.476 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[12] ; mainclk ; mainclk ; None ; None ; 15.189 ns ;
; N/A ; 54.18 MHz ( period = 18.458 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[0] ; mainclk ; mainclk ; None ; None ; 15.159 ns ;
; N/A ; 54.18 MHz ( period = 18.458 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[1] ; mainclk ; mainclk ; None ; None ; 15.159 ns ;
; N/A ; 54.24 MHz ( period = 18.437 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[5] ; mainclk ; mainclk ; None ; None ; 15.138 ns ;
; N/A ; 54.27 MHz ( period = 18.426 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[2] ; mainclk ; mainclk ; None ; None ; 15.130 ns ;
; N/A ; 54.45 MHz ( period = 18.366 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[8] ; mainclk ; mainclk ; None ; None ; 15.070 ns ;
; N/A ; 54.47 MHz ( period = 18.358 ns ) ; fifo_w_delay_count[0] ; ram_addr_buf[4] ; mainclk ; mainclk ; None ; None ; 15.070 ns ;
; N/A ; 54.50 MHz ( period = 18.350 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[10] ; mainclk ; mainclk ; None ; None ; 15.058 ns ;
; N/A ; 54.54 MHz ( period = 18.336 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[9] ; mainclk ; mainclk ; None ; None ; 15.048 ns ;
; N/A ; 54.56 MHz ( period = 18.328 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[8] ; mainclk ; mainclk ; None ; None ; 15.032 ns ;
; N/A ; 54.60 MHz ( period = 18.315 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[7] ; mainclk ; mainclk ; None ; None ; 15.019 ns ;
; N/A ; 54.61 MHz ( period = 18.312 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[10] ; mainclk ; mainclk ; None ; None ; 15.020 ns ;
; N/A ; 54.65 MHz ( period = 18.298 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[9] ; mainclk ; mainclk ; None ; None ; 15.010 ns ;
; N/A ; 54.71 MHz ( period = 18.277 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[7] ; mainclk ; mainclk ; None ; None ; 14.981 ns ;
; N/A ; 54.73 MHz ( period = 18.271 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[3] ; mainclk ; mainclk ; None ; None ; 14.973 ns ;
; N/A ; 54.74 MHz ( period = 18.269 ns ) ; fifo_w_delay_count[4] ; ram_addr_buf[11] ; mainclk ; mainclk ; None ; None ; 14.980 ns ;
; N/A ; 54.80 MHz ( period = 18.248 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[6] ; mainclk ; mainclk ; None ; None ; 14.959 ns ;
; N/A ; 54.82 MHz ( period = 18.240 ns ) ; fifo_w_delay_count[1] ; ram_addr_buf[12] ; mainclk ; mainclk ; None ; None ; 14.953 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[7] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[3] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[6] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[5] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[4] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[0] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[1] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.84 MHz ( period = 18.236 ns ) ; fifo_w_delay_count[12] ; ram_data_buf[2] ; mainclk ; mainclk ; None ; None ; 14.925 ns ;
; N/A ; 54.85 MHz ( period = 18.233 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[3] ; mainclk ; mainclk ; None ; None ; 14.935 ns ;
; N/A ; 54.85 MHz ( period = 18.231 ns ) ; fifo_w_delay_count[5] ; ram_addr_buf[11] ; mainclk ; mainclk ; None ; None ; 14.942 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+------------------------+-----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'write_fifo_in' ;
+-------+------------------------------------------------+------------+------------+---------------+---------------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-------+------------------------------------------------+------------+------------+---------------+---------------+-----------------------------+---------------------------+-------------------------+
; N/A ; Restricted to 360.10 MHz ( period = 2.777 ns ) ; write_fifo ; write_fifo ; write_fifo_in ; write_fifo_in ; None ; None ; 1.316 ns ;
+-------+------------------------------------------------+------------+------------+---------------+---------------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'mainclk' ;
+------------------------------------------+-----------------------------------------------------+----------------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+-----------------------------------------------------+----------------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[437] ; fifo_w_buf[453] ; mainclk ; mainclk ; None ; None ; 0.734 ns ;
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[668] ; fifo_w_buf[684] ; mainclk ; mainclk ; None ; None ; 0.735 ns ;
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[933] ; fifo_w_buf[949] ; mainclk ; mainclk ; None ; None ; 0.735 ns ;
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[492] ; fifo_w_buf[508] ; mainclk ; mainclk ; None ; None ; 0.735 ns ;
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[542] ; fifo_w_buf[558] ; mainclk ; mainclk ; None ; None ; 0.735 ns ;
; Not operational: Clock Skew > Data Delay ; fifo_w_buf_in[807] ; fifo_w_buf[823] ; mainclk ; mainclk ; None ; None ; 0.736 ns ⌨️ 快捷键说明
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