glbl.v

来自「XILINX memory interface generator. XILI」· Verilog 代码 · 共 11 行

V
11 行
字号 
`timescale  1 ns / 1 ps

module glbl ();

    wire GR;
    wire GSR;
    wire GTS;
    wire PRLD;

endmodule

glbl.v - 源码说明

本页面展示了「XILINX memory interface generator. XILINX的外部存储器接口。」中的 glbl.v 源码文件，采用 Verilog 编程语言编写，共 11 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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