📄 plvji.sim.rpt
字号:
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; |plvji|clkx ; |plvji|clkx ; combout ;
; |plvji|clk ; |plvji|clk ; combout ;
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; |plvji|duan[3] ; |plvji|duan[3] ; padio ;
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; |plvji|wei[3] ; |plvji|wei[3] ; padio ;
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; |plvji|wei[1] ; |plvji|wei[1] ; padio ;
; |plvji|wei[0] ; |plvji|wei[0] ; padio ;
+-----------------------------------+-----------------------------------------+------------------+
The following table displays output ports that do not toggle to 1 during simulation.
+---------------------------------------------------------------------------------------------+
; Missing 1-Value Coverage ;
+-----------------------------------+--------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+-----------------------------------+--------------------------------------+------------------+
; |plvji|saomiao:inst1|clkx[7] ; |plvji|saomiao:inst1|clkx[7]~52 ; cout0 ;
; |plvji|saomiao:inst1|clkx[8] ; |plvji|saomiao:inst1|clkx[8]~53 ; cout0 ;
; |plvji|select:inst2|Selector3~497 ; |plvji|select:inst2|Selector3~497 ; combout ;
; |plvji|ceping:inst|data[20] ; |plvji|ceping:inst|data[20] ; regout ;
; |plvji|ceping:inst|data[8] ; |plvji|ceping:inst|data[8] ; regout ;
; |plvji|select:inst2|Selector2~199 ; |plvji|select:inst2|Selector2~199 ; combout ;
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; |plvji|ceping:inst|data[9] ; |plvji|ceping:inst|data[9] ; regout ;
; |plvji|select:inst2|Selector1~199 ; |plvji|select:inst2|Selector1~199 ; combout ;
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; |plvji|select:inst2|Selector0~199 ; |plvji|select:inst2|Selector0~199 ; combout ;
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; |plvji|ceping:inst|min[24] ; |plvji|ceping:inst|min[24] ; regout ;
; |plvji|saomiao:inst1|clkx[6] ; |plvji|saomiao:inst1|clkx[6]~55 ; cout0 ;
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