📄 asm_led.fit.rpt
字号:
; |transform:u1| ; 7 ; 0 ; |asm_led|transform:u1 ;
+----------------------------+------------+------+-----------------------+
+----------------------------------------------------------------------------------------------+
; Control Signals ;
+-------+----------+---------+--------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+-------+----------+---------+--------------+--------+----------------------+------------------+
; clk ; PIN_83 ; 9 ; Clock ; yes ; On ; -- ;
; reset ; PIN_1 ; 9 ; Clock enable ; no ; -- ; -- ;
+-------+----------+---------+--------------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; clk ; PIN_83 ; 9 ; On ; -- ;
+------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------+---------+
; Name ; Fan-Out ;
+-----------------------+---------+
; x[0] ; 14 ;
; x[5] ; 14 ;
; x[2] ; 14 ;
; x[1] ; 14 ;
; x[4] ; 14 ;
; x[3] ; 14 ;
; reset ; 9 ;
; c[0]~reg0 ; 9 ;
; c[2]~reg0 ; 9 ;
; c[1]~reg0 ; 9 ;
; ~GND~0 ; 1 ;
; transform:u1|b[0]~500 ; 1 ;
; transform:u1|b[5]~495 ; 1 ;
; transform:u1|b[3]~491 ; 1 ;
; transform:u1|b[1]~486 ; 1 ;
; transform:u1|b[6]~481 ; 1 ;
; transform:u1|b[0]~477 ; 1 ;
; transform:u1|b[2]~473 ; 1 ;
; Mux~550 ; 1 ;
; Mux~549 ; 1 ;
; Mux~548 ; 1 ;
; Mux~547 ; 1 ;
; Mux~546 ; 1 ;
+-----------------------+---------+
+-----------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+------------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 20 / 288 ( 7 % ) ;
; PIAs ; 20 / 288 ( 7 % ) ;
+----------------------------+------------------+
+----------------------------------------------------------------------------+
; LAB External Interconnect ;
+----------------------------------------------+-----------------------------+
; LAB External Interconnects (Average = 2.50) ; Number of LABs (Total = 3) ;
+----------------------------------------------+-----------------------------+
; 0 ; 5 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 1 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 1 ;
; 8 ; 0 ;
; 9 ; 0 ;
; 10 ; 1 ;
+----------------------------------------------+-----------------------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 2.13) ; Number of LABs (Total = 3) ;
+----------------------------------------+-----------------------------+
; 0 ; 5 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 1 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 1 ;
; 7 ; 0 ;
; 8 ; 1 ;
+----------------------------------------+-----------------------------+
+-------------------------------------------------------------------------------+
; Shareable Expander ;
+-------------------------------------------------+-----------------------------+
; Number of shareable expanders (Average = 0.63) ; Number of LABs (Total = 1) ;
+-------------------------------------------------+-----------------------------+
; 0 ; 7 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 1 ;
+-------------------------------------------------+-----------------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+-----------------------------------------------------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+-----------------------------------------------------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; A ; LC16 ; ; c[3] ;
; A ; LC6 ; c[2]~reg0, c[1]~reg0, c[0]~reg0 ; d[5] ;
; A ; LC3 ; c[1]~reg0, c[2]~reg0, c[0]~reg0 ; d[3] ;
; A ; LC8 ; c[1]~reg0, c[2]~reg0, c[0]~reg0 ; d[6] ;
; A ; LC5 ; c[2]~reg0, c[1]~reg0, c[0]~reg0 ; d[4] ;
; A ; LC14 ; clk, c[0]~reg0, reset, x[3], x[1], x[5], x[0], x[2], x[4] ; c[0]~reg0, transform:u1|b[2]~473, transform:u1|b[0]~477, transform:u1|b[6]~481, c[0], transform:u1|b[1]~486, transform:u1|b[3]~491, transform:u1|b[5]~495, transform:u1|b[0]~500 ;
; A ; LC13 ; clk, c[2]~reg0, reset, x[0], x[2], x[1], x[5], x[3], x[4] ; c[2]~reg0, c[2], transform:u1|b[2]~473, transform:u1|b[0]~477, transform:u1|b[6]~481, transform:u1|b[1]~486, transform:u1|b[3]~491, transform:u1|b[5]~495, transform:u1|b[0]~500 ;
; A ; LC11 ; clk, c[1]~reg0, reset, x[1], x[2], x[5], x[0], x[3], x[4] ; c[1]~reg0, c[1], transform:u1|b[2]~473, transform:u1|b[0]~477, transform:u1|b[6]~481, transform:u1|b[1]~486, transform:u1|b[3]~491, transform:u1|b[5]~495, transform:u1|b[0]~500 ;
; B ; LC29 ; c[1]~reg0, c[2]~reg0, c[0]~reg0 ; d[2] ;
; B ; LC27 ; c[1]~reg0, c[2]~reg0, c[0]~reg0 ; d[1] ;
; B ; LC25 ; c[2]~reg0, c[1]~reg0, c[0]~reg0 ; d[0] ;
; D ; LC49 ; clk, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, reset ; x[3], x[4], x[1], x[2], c[1]~reg0, x[5], c[2]~reg0, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, catn[0], c[0]~reg0 ;
; D ; LC59 ; clk, x[0], x[2], x[1], x[5], x[3], x[4], reset ; x[3], x[4], x[1], x[2], c[1]~reg0, x[5], c[2]~reg0, catn[5], Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, c[0]~reg0 ;
; D ; LC53 ; clk, x[1], x[2], x[5], x[0], x[3], x[4], reset ; x[3], x[4], x[1], x[2], catn[2], c[1]~reg0, x[5], c[2]~reg0, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, c[0]~reg0 ;
; D ; LC51 ; clk, x[2], x[0], x[4], x[3], x[1], x[5], reset ; x[3], x[4], x[1], catn[1], x[2], c[1]~reg0, x[5], c[2]~reg0, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, c[0]~reg0 ;
; D ; LC57 ; clk, x[3], x[4], x[0], x[2], x[1], x[5], reset ; x[3], x[4], catn[4], x[1], x[2], c[1]~reg0, x[5], c[2]~reg0, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, c[0]~reg0 ;
; D ; LC56 ; clk, x[1], x[2], x[5], x[0], x[3], x[4], reset ; x[3], catn[3], x[4], x[1], x[2], c[1]~reg0, x[5], c[2]~reg0, Mux~546, Mux~547, Mux~548, Mux~549, Mux~550, c[0]~reg0 ;
+-----+------------+-----------------------------------------------------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 5.1 Build 176 10/26/2005 SJ Full Version
Info: Processing started: Thu Apr 27 16:14:07 2006
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off asm_led -c asm_led
Info: Selected device EPM7128SLC84-15 for design "asm_led"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Thu Apr 27 16:14:07 2006
Info: Elapsed time: 00:00:01
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