div.tan.rpt
来自「FPGA调试程序」· RPT 代码 · 共 386 行 · 第 1/5 页
RPT
386 行
; N/A ; 93.46 MHz ( period = 10.700 ns ) ; count[20] ; leda[0]~4 ; clk ; clk ; None ; None ; 9.600 ns ;
; N/A ; 93.46 MHz ( period = 10.700 ns ) ; count[23] ; leda[0]~5 ; clk ; clk ; None ; None ; 9.600 ns ;
; N/A ; 93.46 MHz ( period = 10.700 ns ) ; count[20] ; leda[0]~5 ; clk ; clk ; None ; None ; 9.600 ns ;
; N/A ; 93.46 MHz ( period = 10.700 ns ) ; count[23] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.600 ns ;
; N/A ; 93.46 MHz ( period = 10.700 ns ) ; count[20] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.600 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~reg0 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[9] ; count[27] ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[6] ; count[19] ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~2 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~3 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~4 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~5 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[19] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[9] ; count[26] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[9] ; count[25] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[8] ; count[24] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[8] ; count[23] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[13] ; count[30] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[10] ; count[15] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[1] ; count[18] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[6] ; count[22] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 95.24 MHz ( period = 10.500 ns ) ; count[14] ; count[31] ; clk ; clk ; None ; None ; 9.400 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[13] ; count[29] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[12] ; count[28] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[11] ; count[28] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[2] ; count[18] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[10] ; count[9] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[10] ; count[8] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[10] ; count[14] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[10] ; count[0] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 96.15 MHz ( period = 10.400 ns ) ; count[15] ; count[31] ; clk ; clk ; None ; None ; 9.300 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~reg0 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~reg0 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[9] ; count[24] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[9] ; count[23] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[14] ; count[30] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[7] ; count[15] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[7] ; count[18] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[1] ; count[17] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[6] ; count[21] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[10] ; count[20] ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~2 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~2 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~3 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~3 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~4 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~4 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~5 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~5 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[24] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[15] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.200 ns ;
; N/A ; 98.04 MHz ( period = 10.200 ns ) ; count[18] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.100 ns ;
; N/A ; 98.04 MHz ( period = 10.200 ns ) ; count[17] ; leda[0]~6 ; clk ; clk ; None ; None ; 9.100 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+-----------+--------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+-------------------------------------------------------------------------+
; tco ;
+-------+--------------+------------+--------------+---------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-------+--------------+------------+--------------+---------+------------+
; N/A ; None ; 9.900 ns ; leda[0]~6 ; leda[5] ; clk ;
; N/A ; None ; 9.900 ns ; leda[0]~5 ; leda[4] ; clk ;
; N/A ; None ; 9.900 ns ; leda[0]~4 ; leda[3] ; clk ;
; N/A ; None ; 9.900 ns ; leda[0]~3 ; leda[2] ; clk ;
; N/A ; None ; 9.900 ns ; leda[0]~2 ; leda[1] ; clk ;
; N/A ; None ; 9.900 ns ; leda[0]~reg0 ; leda[0] ; clk ;
+-------+--------------+------------+--------------+---------+------------+
+--------------------------+
; Timing Analyzer Messages ;
+--------------------------+
Info: *******************************************************************
Info: Running Quartus II Classic Timing Analyzer
Info: Version 7.0 Build 33 02/05/2007 SJ Full Version
Info: Processing started: Tue Nov 25 10:38:12 2008
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