crystal.tan.rpt

VHDL基础的编程源代码

; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[4]  ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[5]  ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[6]  ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[8]  ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[15] ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[14] ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[13] ; counter:inst|delay_counter[23] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[15] ; counter:inst|delay_counter[24] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[14] ; counter:inst|delay_counter[24] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[10] ; counter:inst|delay_counter[24] ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[4]  ; counter:inst|delay_counter[6]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[6]  ; counter:inst|delay_counter[6]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
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; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[5]  ; counter:inst|delay_counter[5]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[2]  ; counter:inst|delay_counter[4]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[3]  ; counter:inst|delay_counter[4]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[4]  ; counter:inst|delay_counter[4]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[2]  ; counter:inst|delay_counter[3]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; N/A                                     ; 97.09 MHz ( period = 10.300 ns )                    ; counter:inst|delay_counter[3]  ; counter:inst|delay_counter[3]  ; clock_24M  ; clock_24M ; None                        ; None                      ; 5.800 ns                ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ;                                ;                                ;            ;           ;                             ;                           ;                         ;
+-----------------------------------------+-----------------------------------------------------+--------------------------------+--------------------------------+------------+-----------+-----------------------------+---------------------------+-------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clock_40M'                                                                                                                                                                                                                                                       ;
+-----------------------------------------+-----------------------------------------------------+---------------------------------+---------------------------------+------------+-----------+-----------------------------+---------------------------+-------------------------+
; Slack                                   ; Actual fmax (period)                                ; From                            ; To                              ; From Clock ; To Clock  ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+---------------------------------+---------------------------------+------------+-----------+-----------------------------+---------------------------+-------------------------+
; N/A                                     ; 82.64 MHz ( period = 12.100 ns )                    ; counter:inst1|delay_counter[0]  ; counter:inst1|delay_counter[8]  ; clock_40M  ; clock_40M ; None                        ; None                      ; 7.600 ns                ;
; N/A