📄 cnt_fry.sim.rpt
字号:
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; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[4] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[4] ; sout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[3] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[3] ; cout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[3] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[3] ; sout ;
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; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[2] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[2] ; sout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[1] ; cout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; sout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[0] ; cout ;
; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |cnt_fry|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; sout ;
+------------------------------------------------------------------------------+------------------------------------------------------------------------------+------------------+
The following table displays output ports that do not toggle to 1 during simulation.
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Missing 1-Value Coverage ;
+------------------------------------------------------------------------------+------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+------------------------------------------------------------------------------+------------------------------------------------------------------------------+------------------+
; |cnt_fry|seg[1]$latch ; |cnt_fry|seg[1]$latch ; out ;
; |cnt_fry|seg[0]$latch ; |cnt_fry|seg[0]$latch ; out ;
; |cnt_fry|dat0~5 ; |cnt_fry|dat0~5 ; out ;
; |cnt_fry|dat0~6 ; |cnt_fry|dat0~6 ; out ;
; |cnt_fry|dat0~7 ; |cnt_fry|dat0~7 ; out ;
; |cnt_fry|dat0~8 ; |cnt_fry|dat0~8 ; out ;
; |cnt_fry|dat1~4 ; |cnt_fry|dat1~4 ; out ;
; |cnt_fry|dat1~5 ; |cnt_fry|dat1~5 ; out ;
; |cnt_fry|dat1~6 ; |cnt_fry|dat1~6 ; out ;
; |cnt_fry|dat1~7 ; |cnt_fry|dat1~7 ; out ;
; |cnt_fry|dat1~8 ; |cnt_fry|dat1~8 ; out ;
; |cnt_fry|dat1~9 ; |cnt_fry|dat1~9 ; out ;
; |cnt_fry|dat1~10 ; |cnt_fry|dat1~10 ; out ;
; |cnt_fry|dat1~11 ; |cnt_fry|dat1~11 ; out ;
; |cnt_fry|dat2~4 ; |cnt_fry|dat2~4 ; out ;
; |cnt_fry|dat2~5 ; |cnt_fry|dat2~5 ; out ;
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