com9s.vhd

来自「vhdl course 100 case」· VHDL 代码 · 共 6 行

VHD

6 行

--com9s.vhd	9's generator
library ieee ;
use ieee.std_logic_1164.all;
entity com9s is
port(
  a : in std_logic_vector(3 downto 0);--块

com9s.vhd - 源码说明

本页面展示了「vhdl course 100 case」中的 com9s.vhd 源码文件，采用 VHDL 编程语言编写，共 6 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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