📄 dds_top.fit.rpt
字号:
+----------------------------------------------------------------------------------------+
; Fitter Device Options ;
+----------------------------------------------+-----------------------------------------+
; Option ; Setting ;
+----------------------------------------------+-----------------------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Active Serial ;
; Error detection CRC ; Off ;
; Reserve ASDO pin after configuration. ; As output driving an unspecified signal ;
; Reserve all unused pins ; As input tri-stated ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+-----------------------------------------+
+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in D:/111/dds_top.fit.eqn.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/111/dds_top.pin.
+-------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+---------------------------+
; Resource ; Usage ;
+---------------------------------------------+---------------------------+
; Total logic elements ; 271 / 12,060 ( 2 % ) ;
; -- Combinational with no register ; 105 ;
; -- Register only ; 9 ;
; -- Combinational with a register ; 157 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 115 ;
; -- 3 input functions ; 47 ;
; -- 2 input functions ; 79 ;
; -- 1 input functions ; 26 ;
; -- 0 input functions ; 4 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 230 ;
; -- arithmetic mode ; 41 ;
; -- qfbk mode ; 38 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 47 ;
; -- asynchronous clear/load mode ; 130 ;
; ; ;
; Total LABs ; 33 / 1,206 ( 2 % ) ;
; Logic elements in carry chains ; 47 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 44 / 173 ( 25 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 8 ;
; M4Ks ; 20 / 52 ( 38 % ) ;
; Total memory bits ; 81,920 / 239,616 ( 34 % ) ;
; Total RAM block bits ; 92,160 / 239,616 ( 38 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; Maximum fan-out node ; cl ;
; Maximum fan-out ; 130 ;
; Total fan-out ; 1410 ;
; Average fan-out ; 4.18 ;
+---------------------------------------------+---------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; 48mhz ; 28 ; 1 ; 0 ; 15 ; 2 ; 11 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; cl ; 122 ; 3 ; 53 ; 1 ; 0 ; 130 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; cpp0 ; 123 ; 3 ; 53 ; 2 ; 2 ; 20 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; cpx0 ; 124 ; 3 ; 53 ; 2 ; 1 ; 20 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; key1 ; 121 ; 3 ; 53 ; 1 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; key7 ; 158 ; 3 ; 53 ; 19 ; 0 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; key8 ; 156 ; 3 ; 53 ; 16 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; aa ; 169 ; 3 ; 53 ; 23 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; bb ; 170 ; 3 ; 53 ; 23 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; cc ; 167 ; 3 ; 53 ; 22 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; clk ; 38 ; 1 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dd ; 168 ; 3 ; 53 ; 23 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig0 ; 160 ; 3 ; 53 ; 20 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig1 ; 159 ; 3 ; 53 ; 20 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig2 ; 162 ; 3 ; 53 ; 21 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig3 ; 161 ; 3 ; 53 ; 20 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig4 ; 136 ; 3 ; 53 ; 5 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; dig5 ; 137 ; 3 ; 53 ; 6 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; ee ; 165 ; 3 ; 53 ; 22 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; ff ; 166 ; 3 ; 53 ; 22 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; gg ; 163 ; 3 ; 53 ; 21 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; hh ; 164 ; 3 ; 53 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; m1 ; 8 ; 1 ; 0 ; 24 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
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