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字号:
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; |altsyncram_e9a2:altsyncram1| ; 0 (0) ; 0 ; 8192 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top|user_interface:inst3|ram512:ram512_inst|altsyncram:altsyncram_component|altsyncram_0qe1:auto_generated|altsyncram_e9a2:altsyncram1 ; work ;
; |sld_mod_ram_rom:mgl_prim2| ; 71 (50) ; 45 ; 0 ; 0 ; 0 ; 26 (14) ; 4 (4) ; 41 (32) ; 19 (14) ; 0 (0) ; |top|user_interface:inst3|ram512:ram512_inst|altsyncram:altsyncram_component|altsyncram_0qe1:auto_generated|sld_mod_ram_rom:mgl_prim2 ; work ;
; |sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr| ; 21 (21) ; 9 ; 0 ; 0 ; 0 ; 12 (12) ; 0 (0) ; 9 (9) ; 5 (5) ; 0 (0) ; |top|user_interface:inst3|ram512:ram512_inst|altsyncram:altsyncram_component|altsyncram_0qe1:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr ; work ;
; |rom256:rom256_inst| ; 74 (0) ; 44 ; 4096 ; 0 ; 0 ; 30 (0) ; 4 (0) ; 40 (0) ; 18 (0) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst ; work ;
; |altsyncram:altsyncram_component| ; 74 (0) ; 44 ; 4096 ; 0 ; 0 ; 30 (0) ; 4 (0) ; 40 (0) ; 18 (0) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component ; work ;
; |altsyncram_2361:auto_generated| ; 74 (0) ; 44 ; 4096 ; 0 ; 0 ; 30 (0) ; 4 (0) ; 40 (0) ; 18 (0) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component|altsyncram_2361:auto_generated ; work ;
; |altsyncram_fk72:altsyncram1| ; 0 (0) ; 0 ; 4096 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component|altsyncram_2361:auto_generated|altsyncram_fk72:altsyncram1 ; work ;
; |sld_mod_ram_rom:mgl_prim2| ; 74 (49) ; 44 ; 0 ; 0 ; 0 ; 30 (14) ; 4 (4) ; 40 (31) ; 18 (13) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component|altsyncram_2361:auto_generated|sld_mod_ram_rom:mgl_prim2 ; work ;
; |sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr| ; 25 (25) ; 9 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 9 (9) ; 5 (5) ; 0 (0) ; |top|user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component|altsyncram_2361:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr ; work ;
+------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis RAM Summary ;
+-----------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+---------------+
; Name ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF ;
+-----------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+---------------+
; user_interface:inst3|ram512:ram512_inst|altsyncram:altsyncram_component|altsyncram_0qe1:auto_generated|altsyncram_e9a2:altsyncram1|ALTSYNCRAM ; AUTO ; True Dual Port ; 512 ; 16 ; 512 ; 16 ; 8192 ; ram512.hex ;
; user_interface:inst3|rom256:rom256_inst|altsyncram:altsyncram_component|altsyncram_2361:auto_generated|altsyncram_fk72:altsyncram1|ALTSYNCRAM ; AUTO ; True Dual Port ; 256 ; 16 ; 256 ; 16 ; 4096 ; rom_value.hex ;
+-----------------------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+------+---------------+
Encoding Type: One-Hot
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |top|user_interface:inst3|user_state ;
+---------------------------+-----------------+--------------------------+-------------------------+---------------------------+--------------------------+-----------------------+
; Name ; user_state.idle ; user_state.wait_read_ack ; user_state.gen_read_req ; user_state.wait_write_ack ; user_state.gen_write_req ; user_state.wait_setup ;
+---------------------------+-----------------+--------------------------+-------------------------+---------------------------+--------------------------+-----------------------+
; user_state.wait_setup ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; user_state.gen_write_req ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;
; user_state.wait_write_ack ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;
; user_state.gen_read_req ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;
; user_state.wait_read_ack ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;
; user_state.idle ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;
+---------------------------+-----------------+--------------------------+-------------------------+---------------------------+--------------------------+-----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Registers Protected by Synthesis ;
+---------------------------------------+------------------------------------------------------------------+--------------------------------------------+
; Register Name ; Protected by Synthesis Attribute or Preserve Register Assignment ; Not to be Touched by Netlist Optimizations ;
+---------------------------------------+------------------------------------------------------------------+--------------------------------------------+
; sdram_top:inst|init_fsm:U1|clk_cnt[0] ; yes ; yes ;
; sdram_top:inst|init_fsm:U1|clk_cnt[1] ; yes ; yes ;
; sdram_top:inst|init_fsm:U1|clk_cnt[2] ; yes ; yes ;
; sdram_top:inst|init_fsm:U1|clk_cnt[3] ; yes ; yes ;
+---------------------------------------+------------------------------------------------------------------+--------------------------------------------+
+-----------------------------------------------------------------------------------------------------------------+
; Registers Removed During Synthesis ;
+------------------------------------------------------+----------------------------------------------------------+
; Register name ; Reason for Removal ;
+------------------------------------------------------+----------------------------------------------------------+
; sdram_top:inst|sdr_sig:U3|sdr_CKE ; Stuck at VCC due to stuck port data_in ;
; user_interface:inst3|wren ; Stuck at VCC due to stuck port data_in ;
; sdram_top:inst|sdr_sig:U3|sdr_DMQ[0] ; Merged with sdram_top:inst|sdr_sig:U3|sdr_DMQ[1] ;
; user_interface:inst3|sys_addr[1..3] ; Merged with user_interface:inst3|sys_addr[0] ;
; user_interface:inst3|sys_addr[5..21] ; Merged with user_interface:inst3|sys_addr[4] ;
; user_interface:inst3|burst_len[1..7] ; Merged with user_interface:inst3|burst_len[0] ;
; sdram_top:inst|main_fsm:U0|keep_burst_len[0..2,4..7] ; Merged with sdram_top:inst|main_fsm:U0|keep_burst_len[3] ;
; sdram_top:inst|sdr_sig:U3|sdr_BA[0] ; Merged with sdram_top:inst|sdr_sig:U3|sdr_BA[1] ;
; sdram_top:inst|sdr_sig:U3|sdr_ADDR[8..10] ; Merged with sdram_top:inst|sdr_sig:U3|sdr_ADDR[11] ;
; sdram_top:inst|sdr_sig:U3|sdr_ADDR[4,6] ; Merged with sdram_top:inst|sdr_sig:U3|sdr_ADDR[7] ;
; sdram_top:inst|sdr_sig:U3|sdr_ADDR[0..1] ; Merged with sdram_top:inst|sdr_sig:U3|sdr_ADDR[2] ;
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