clock.vhdsim_synth

来自「XLINX做的数字钟」· VHDSIM_SYNTH 代码 · 共 3 行

VHDSIM_SYNTH
3 行
字号 
CLOCK.vhdsim_synth -- generated only for ProjNav status tracking
Simulation Model Target: ModelSim SE (VHDL)

clock.vhdsim_synth - 源码说明

本页面展示了「XLINX做的数字钟」中的 clock.vhdsim_synth 源码文件，采用 VHDSIM_SYNTH 编程语言编写，共 3 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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