📄 proj.tan.rpt
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; Cut paths between unrelated clock domains ; On ; ; ; ;
; Cut off read during write signal paths ; On ; ; ; ;
; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; Off ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
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+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+-------------------------+-------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+-------------------------+-------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 104.88 MHz ( period = 9.535 ns ) ; lcd:inst|counter[5] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 7.032 ns ;
; N/A ; 105.62 MHz ( period = 9.468 ns ) ; lcd:inst|counter[0] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 6.965 ns ;
; N/A ; 107.10 MHz ( period = 9.337 ns ) ; lcd:inst|counter[2] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 6.834 ns ;
; N/A ; 107.34 MHz ( period = 9.316 ns ) ; lcd:inst|counter[4] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 6.813 ns ;
; N/A ; 107.46 MHz ( period = 9.306 ns ) ; lcd:inst|counter[3] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 6.803 ns ;
; N/A ; 108.42 MHz ( period = 9.223 ns ) ; lcd:inst|counter[1] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 6.720 ns ;
; N/A ; 120.70 MHz ( period = 8.285 ns ) ; lcd:inst|state[2] ; lcd:inst|state[9] ; clk ; clk ; None ; None ; 5.782 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 121.46 MHz ( period = 8.233 ns ) ; lcd:inst|counter[5] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.730 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 122.46 MHz ( period = 8.166 ns ) ; lcd:inst|counter[0] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.663 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.46 MHz ( period = 8.035 ns ) ; lcd:inst|counter[2] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.532 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[4] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[5] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.78 MHz ( period = 8.014 ns ) ; lcd:inst|counter[4] ; lcd:inst|counter[3] ; clk ; clk ; None ; None ; 5.511 ns ;
; N/A ; 124.94 MHz ( period = 8.004 ns ) ; lcd:inst|counter[3] ; lcd:inst|counter[0] ; clk ; clk ; None ; None ; 5.501 ns ;
; N/A ; 124.94 MHz ( period = 8.004 ns ) ; lcd:inst|counter[3] ; lcd:inst|counter[1] ; clk ; clk ; None ; None ; 5.501 ns ;
; N/A ; 124.94 MHz ( period = 8.004 ns ) ; lcd:inst|counter[3] ; lcd:inst|counter[2] ; clk ; clk ; None ; None ; 5.501 ns ;
; N/A ; 124.94 MHz ( period = 8.004 ns ) ; lcd:inst|counter[3] ; lcd:inst|counter[6] ; clk ; clk ; None ; None ; 5.501 ns ;
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