📄 decoder.fit.rpt
字号:
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; Global clocks ; 2 / 8 ( 25 % ) ;
; Maximum fan-out node ; switch:inst7|i4~55 ;
; Maximum fan-out ; 18 ;
; Total fan-out ; 283 ;
; Average fan-out ; 3.29 ;
+-----------------------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk ; 125 ; 2 ; 16 ; 14 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; reset ; 17 ; 1 ; 0 ; 7 ; 0 ; 18 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[0] ; 55 ; 4 ; 16 ; 0 ; 2 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[1] ; 57 ; 4 ; 16 ; 0 ; 0 ; 13 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[2] ; 59 ; 4 ; 18 ; 0 ; 0 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[3] ; 61 ; 4 ; 20 ; 0 ; 1 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[4] ; 52 ; 4 ; 12 ; 0 ; 2 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[5] ; 53 ; 4 ; 12 ; 0 ; 1 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[6] ; 58 ; 4 ; 18 ; 0 ; 1 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[7] ; 54 ; 4 ; 12 ; 0 ; 0 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; vel[8] ; 62 ; 4 ; 20 ; 0 ; 0 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; Turbo Bit ; I/O Standard ; Current Strength ; Termination ; Location assigned by ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
; out ; 56 ; 4 ; 16 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
+------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+-------------------------------------------------------------
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 3 / 22 ( 13 % ) ; 3.3V ; -- ;
; 2 ; 1 / 28 ( 3 % ) ; 3.3V ; -- ;
; 3 ; 0 / 26 ( 0 % ) ; 3.3V ; -- ;
; 4 ; 10 / 28 ( 35 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+-----------------------------------------------------------------------------------------+
; All Package Pins ;
+------------------------------------------------------------------------------------------
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; I/O Standard ; Voltage ; I/O Type ;
+----------+------------+----------+----------------+--------------+---------+------------+
; 1 ; 0 ; 1 ; GND* ; ; ; Row I/O ;
; 2 ; 1 ; 1 ; GND* ; ; ; Row I/O ;
; 3 ; 2 ; 1 ; GND* ; ; ; Row I/O ;
; 4 ; 3 ; 1 ; GND* ; ; ; Row I/O ;
; 5 ; 4 ; 1 ; GND* ; ; ; Row I/O ;
; 6 ; 5 ; 1 ; GND* ; ; ; Row I/O ;
; 7 ; 6 ; 1 ; GND* ; ; ; Row I/O ;
; 8 ; ; 1 ; VCCIO1 ; ; 3.3V ; -- ;
; 9 ; ; 1 ; GND ; ; ; -- ;
; 10 ; 7 ; 1 ; GND* ; ; ; Row I/O ;
; 11 ; 8 ; 1 ; GND* ; ; ; Row I/O ;
; 12 ; 9 ; 1 ; *~nCSO~ / GND* ; LVTTL ; ; Row I/O ;
; 13 ; 10 ; 1 ; ^DATA0 ; ; ; -- ;
; 14 ; 11 ; 1 ; ^nCONFIG ; ; ; -- ;
; 15 ; ; 1 ; VCCA_PLL1 ; ; 1.5V ; -- ;
; 16 ; 12 ; 1 ; GND+ ; ; ; Row I/O ;
; 17 ; 13 ; 1 ; reset ; LVTTL ; ; Row I/O ;
; 18 ; ; 1 ; GNDA_PLL1 ; ; ; -- ;
; 19 ; ; 1 ; GNDG_PLL1 ; ; ; -- ;
; 20 ; 14 ; 1 ; ^nCEO ; ; ; -- ;
; 21 ; 15 ; 1 ; ^nCE ; ; ; -- ;
; 22 ; 16 ; 1 ; ^MSEL0 ; ; ; -- ;
; 23 ; 17 ; 1 ; ^MSEL1 ; ; ; -- ;
; 24 ; 18 ; 1 ; ^DCLK ; ; ; -- ;
; 25 ; 19 ; 1 ; *~ASDO~ / GND* ; LVTTL ; ; Row I/O ;
; 26 ; 20 ; 1 ; GND* ; ; ; Row I/O ;
; 27 ; 21 ; 1 ; GND* ; ; ; Row I/O ;
; 28 ; 22 ; 1 ; GND* ; ; ; Row I/O ;
; 29 ; ; 1 ; VCCIO1 ; ; 3.3V ; -- ;
; 30 ; ; 1 ; GND ; ; ; -- ;
; 31 ; 23 ; 1 ; GND* ; ; ; Row I/O ;
; 32 ; 24 ; 1 ; GND* ; ; ; Row I/O ;
; 33 ; 25 ; 1 ; GND* ; ; ; Row I/O ;
; 34 ; 26 ; 1 ; GND* ; ; ; Row I/O ;
; 35 ; 27 ; 1 ; GND* ; ; ; Row I/O ;
; 36 ; 28 ; 1 ; GND* ; ; ; Row I/O ;
; 37 ; 29 ; 4 ; GND* ; ; ; Column I/O ;
; 38 ; 30 ; 4 ; GND* ; ; ; Column I/O ;
; 39 ; 31 ; 4 ; GND* ; ; ; Column I/O ;
; 40 ; 32 ; 4 ; GND* ; ; ; Column I/O ;
; 41 ; 33 ; 4 ; GND* ; ; ; Column I/O ;
; 42 ; 34 ; 4 ; GND* ; ; ; Column I/O ;
; 43 ; ; 1 ; GND ; ; ; -- ;
; 44 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ;
; 45 ; ; 1 ; GND ; ; ; -- ;
; 46 ; ; ; VCCINT ; ; 1.5V ; -- ;
; 47 ; 35 ; 4 ; GND* ; ; ; Column I/O ;
; 48 ; 36 ; 4 ; GND* ; ; ; Column I/O ;
; 49 ; 37 ; 4 ; GND* ; ; ; Column I/O ;
; 50 ; 38 ; 4 ; GND* ; ; ; Column I/O ;
; 51 ; 39 ; 4 ; GND* ; ; ; Column I/O ;
; 52 ; 40 ; 4 ; vel[4] ; LVTTL ; ; Column I/O ;
; 53 ; 41 ; 4 ; vel[5] ; LVTTL ; ; Column I/O ;
; 54 ; 42 ; 4 ; vel[7] ; LVTTL ; ; Column I/O ;
; 55 ; 43 ; 4 ; vel[0] ; LVTTL ; ; Column I/O ;
; 56 ; 44 ; 4 ; out ; LVTTL ; ; Column I/O ;
; 57 ; 45 ; 4 ; vel[1] ; LVTTL ; ; Column I/O ;
; 58 ; 46 ; 4 ; vel[6] ; LVTTL ; ; Column I/O ;
; 59 ; 47 ; 4 ; vel[2] ; LVTTL ; ; Column I/O ;
; 60 ; 48 ; 4 ; GND* ; ; ; Column I/O ;
; 61 ; 49 ; 4 ; vel[3] ; LVTTL ; ; Column I/O ;
; 62 ; 50 ; 4 ; vel[8] ; LVTTL ; ; Column I/O ;
; 63 ; ; 1 ; GND ; ; ; -- ;
; 64 ; ; ; VCCINT ; ; 1.5V ; -- ;
; 65 ; ; 1 ; GND ; ; ; -- ;
; 66 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ;
; 67 ; 51 ; 4 ; GND* ; ; ; Column I/O ;
; 68 ; 52 ; 4 ; GND* ; ; ; Column I/O ;
; 69 ; 53 ; 4 ; GND* ; ; ; Column I/O ;
; 70 ; 54 ; 4 ; GND* ; ; ; Column I/O ;
; 71 ; 55 ; 4 ; GND* ; ; ; Column I/O ;
; 72 ; 56 ; 4 ; GND* ; ; ; Column I/O ;
; 73 ; 57 ; 3 ; GND* ; ; ; Row I/O ;
; 74 ; 58 ; 3 ; GND* ; ; ; Row I/O ;
; 75 ; 59 ; 3 ; GND* ; ; ; Row I/O ;
; 76 ; 60 ; 3 ; GND* ; ; ; Row I/O ;
; 77 ; 61 ; 3 ; GND* ; ; ; Row I/O ;
; 78 ; 62 ; 3 ; GND* ; ; ; Row I/O ;
; 79 ; 63 ; 3 ; GND* ; ; ; Row I/O ;
; 80 ; ; 1 ; GND ; ; ; -- ;
; 81 ; ; 3 ; VCCIO3 ; ; 3.3V ; -- ;
; 82 ; 64 ; 3 ; GND* ; ; ; Row I/O ;
; 83 ; 65 ; 3 ; GND* ; ; ; Row I/O ;
; 84 ; 66 ; 3 ; GND* ; ; ; Row I/O ;
; 85 ; 67 ; 3 ; GND* ; ; ; Row I/O ;
; 86 ; 68 ; 3 ; ^CONF_DONE ; ; ; -- ;
; 87 ; 69 ; 3 ; ^nSTATUS ; ; ; -- ;
; 88 ; 70 ; 3 ; #TCK ; ; ; -- ;
; 89 ; 71 ; 3 ; #TMS ; ; ; -- ;
; 90 ; 72 ; 3 ; #TDO ; ; ; -- ;
; 91 ; 73 ; 3 ; GND* ; ; ; Row I/O ;
; 92 ; 74 ; 3 ; GND+ ; ; ; Row I/O ;
; 93 ; 75 ; 3 ; GND+ ; ; ; Row I/O ;
; 94 ; 76 ; 3 ; GND* ; ; ; Row I/O ;
; 95 ; 77 ; 3 ; #TDI ; ; ; -- ;
; 96 ; 78 ; 3 ; GND* ; ; ; Row I/O ;
; 97 ; 79 ; 3 ; GND* ; ; ; Row I/O ;
; 98 ; 80 ; 3 ; GND* ; ; ; Row I/O ;
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