altpll0_waveforms.html

来自「基于DDS原理的正弦信号发生器。用VERILOG语言实现」· HTML 代码 · 共 14 行

HTML

14 行

<html>
<head>
<title>Sample Waveforms for altpll0.v </title>
</head>
<body>
<h2><CENTER>Sample behavioral waveforms for design file altpll0.v </CENTER></h2>
<P>The following waveforms show the behavior of altpll megafunction for the chosen set of parameters in design altpll0.v. The design altpll0.v has Cyclone II PLL_TYPE pll configured in NORMAL mode The primary clock input to the PLL is INCLK0, with clock period 20000 ps. </P>
<CENTER><img src=altpll0_wave0.jpg> </CENTER>
<P><CENTER><FONT size=2>Fig. 1 : Wave showing NORMAL mode operation. </CENTER></P>
<P><FONT size=3></P>
<P></P>
</body>
</html>

altpll0_waveforms.html - 源码说明

本页面展示了「基于DDS原理的正弦信号发生器。用VERILOG语言实现」中的 altpll0_waveforms.html 源码文件，采用 HTML 编程语言编写，共 14 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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