📄 _primary.vhd
字号:
library verilog;use verilog.vl_types.all;entity shuju is port( rst : in vl_logic; sclk : in vl_logic; sdata : out vl_logic );end shuju;
⌨️ 快捷键说明
复制代码
Ctrl + C
搜索代码
Ctrl + F
全屏模式
F11
切换主题
Ctrl + Shift + D
显示快捷键
?
增大字号
Ctrl + =
减小字号
Ctrl + -