📄 de2_lcm_ccd.map.rpt
字号:
+--------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; |DE2_LCM_CCD ; 1339 (45) ; 913 (46) ; 42968 ; 0 ; 0 ; 0 ; 425 ; 0 ; |DE2_LCM_CCD ; work ;
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; |I2C_AV_Config:u9| ; 87 (39) ; 57 (28) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_AV_Config:u9 ; work ;
; |I2C_Controller:u0| ; 48 (48) ; 29 (29) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_AV_Config:u9|I2C_Controller:u0 ; work ;
; |altsyncram:Ram0_rtl_0| ; 0 (0) ; 0 (0) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_AV_Config:u9|altsyncram:Ram0_rtl_0 ; work ;
; |altsyncram_vov:auto_generated| ; 0 (0) ; 0 (0) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_AV_Config:u9|altsyncram:Ram0_rtl_0|altsyncram_vov:auto_generated ; work ;
; |I2C_CCD_Config:u7| ; 117 (72) ; 67 (41) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_CCD_Config:u7 ; work ;
; |I2C_Controller:u0| ; 45 (45) ; 26 (26) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2C_CCD_Config:u7|I2C_Controller:u0 ; work ;
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; |I2S_Controller:u0| ; 48 (48) ; 27 (27) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|I2S_LCM_Config:u8|I2S_Controller:u0 ; work ;
; |RAW2RGB:u4| ; 88 (72) ; 62 (51) ; 25560 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|RAW2RGB:u4 ; work ;
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; |shift_taps_gkn:auto_generated| ; 16 (0) ; 11 (0) ; 25560 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|RAW2RGB:u4|Line_Buffer:u0|altshift_taps:altshift_taps_component|shift_taps_gkn:auto_generated ; work ;
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; |cntr_3rf:cntr1| ; 16 (16) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|RAW2RGB:u4|Line_Buffer:u0|altshift_taps:altshift_taps_component|shift_taps_gkn:auto_generated|cntr_3rf:cntr1 ; work ;
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; |SPI_Control:u11| ; 281 (281) ; 132 (132) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|SPI_Control:u11 ; work ;
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; |Sdram_FIFO:read_fifo1| ; 16 (0) ; 12 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1 ; work ;
; |dcfifo:dcfifo_component| ; 16 (0) ; 12 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component ; work ;
; |dcfifo_m2o1:auto_generated| ; 16 (4) ; 12 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated ; work ;
; |a_gray2bin_kdb:wrptr_g_gray2bin| ; 1 (1) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_gray2bin_kdb:wrptr_g_gray2bin ; work ;
; |a_graycounter_egc:wrptr_gp| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_graycounter_egc:wrptr_gp ; work ;
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; |dcfifo:dcfifo_component| ; 16 (0) ; 12 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component ; work ;
; |dcfifo_m2o1:auto_generated| ; 16 (4) ; 12 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated ; work ;
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; |Sdram_FIFO:write_fifo1| ; 67 (0) ; 82 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1 ; work ;
; |dcfifo:dcfifo_component| ; 67 (0) ; 82 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component ; work ;
; |dcfifo_m2o1:auto_generated| ; 67 (27) ; 82 (21) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated ; work ;
; |a_gray2bin_kdb:rdptr_g_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_gray2bin_kdb:rdptr_g_gray2bin ; work ;
; |a_gray2bin_kdb:rs_dgwp_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_gray2bin_kdb:rs_dgwp_gray2bin ; work ;
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; |dffpipe_ngh:rdaclr| ; 0 (0) ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|dffpipe_ngh:rdaclr ; work ;
; |Sdram_FIFO:write_fifo2| ; 67 (0) ; 82 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2 ; work ;
; |dcfifo:dcfifo_component| ; 67 (0) ; 82 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component ; work ;
; |dcfifo_m2o1:auto_generated| ; 67 (27) ; 82 (21) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated ; work ;
; |a_gray2bin_kdb:rdptr_g_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_gray2bin_kdb:rdptr_g_gray2bin ; work ;
; |a_gray2bin_kdb:rs_dgwp_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_gray2bin_kdb:rs_dgwp_gray2bin ; work ;
; |a_graycounter_egc:wrptr_gp| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_graycounter_egc:wrptr_gp ; work ;
; |a_graycounter_o96:rdptr_g1p| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|a_graycounter_o96:rdptr_g1p ; work ;
; |alt_synch_pipe_qdb:rs_dgwp| ; 0 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|alt_synch_pipe_qdb:rs_dgwp ; work ;
; |dffpipe_oe9:dffpipe9| ; 0 (0) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|alt_synch_pipe_qdb:rs_dgwp|dffpipe_oe9:dffpipe9 ; work ;
; |alt_synch_pipe_ud8:ws_dgrp| ; 0 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|alt_synch_pipe_ud8:ws_dgrp ; work ;
; |dffpipe_pe9:dffpipe11| ; 0 (0) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|alt_synch_pipe_ud8:ws_dgrp|dffpipe_pe9:dffpipe11 ; work ;
; |altsyncram_1l81:fifo_ram| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|altsyncram_1l81:fifo_ram ; work ;
; |altsyncram_drg1:altsyncram5| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|altsyncram_1l81:fifo_ram|altsyncram_drg1:altsyncram5 ; work ;
; |dffpipe_kec:rs_brp| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|dffpipe_kec:rs_brp ; work ;
; |dffpipe_kec:rs_bwp| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|dffpipe_kec:rs_bwp ; work ;
; |dffpipe_ngh:rdaclr| ; 0 (0) ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2|dcfifo:dcfifo_component|dcfifo_m2o1:auto_generated|dffpipe_ngh:rdaclr ; work ;
; |Sdram_PLL:sdram_pll1| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_PLL:sdram_pll1 ; work ;
; |altpll:altpll_component| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_PLL:sdram_pll1|altpll:altpll_component ; work ;
; |command:command1| ; 61 (61) ; 48 (48) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|command:command1 ; work ;
; |control_interface:control1| ; 63 (63) ; 55 (55) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|control_interface:control1 ; work ;
+--------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
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