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📄 block.fit.rpt

📁 基于FPGA的多功能电子时钟的设计很经典的哦
💻 RPT
📖 第 1 页 / 共 4 页
字号:
; CLK1                      ; 7       ; 4       ; Clock                      ; Non-global   ;
; CLK3                      ; 9       ; 4       ; Clock                      ; Non-global   ;
; CLK5                      ; 12      ; 6       ; Clock                      ; Non-global   ;
; CLK6                      ; 15      ; 4       ; Clock                      ; Non-global   ;
; clk_div:inst22|Equal0~72  ; LC3_E1  ; 1       ; Clock enable               ; Non-global   ;
; clk_div:inst22|Equal1~36  ; LC3_H16 ; 1       ; Clock enable               ; Non-global   ;
+---------------------------+---------+---------+----------------------------+--------------+


+----------------------------------------------------+
; Global & Other Fast Signals                        ;
+-----------------------+---------+---------+--------+
; Name                  ; Pin #   ; Fan-Out ; Global ;
+-----------------------+---------+---------+--------+
; CLK                   ; 78      ; 19      ; yes    ;
; clk_div:inst22|clk2_2 ; LC1_H16 ; 13      ; yes    ;
+-----------------------+---------+---------+--------+


+---------------------------------------------+
; Carry Chains                                ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0                  ; 0                      ;
; 1                  ; 0                      ;
; 2                  ; 0                      ;
; 3                  ; 0                      ;
; 4                  ; 2                      ;
; 5                  ; 1                      ;
; 6                  ; 0                      ;
; 7                  ; 0                      ;
; 8                  ; 0                      ;
; 9                  ; 1                      ;
+--------------------+------------------------+


+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2      ; 1     ;
+--------+-------+


+-------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                                                       ;
+---------------------------------------------------------------------------------------------+---------+
; Name                                                                                        ; Fan-Out ;
+---------------------------------------------------------------------------------------------+---------+
; RST0                                                                                        ; 31      ;
; zhongbai:inst30|present~87                                                                  ; 12      ;
; RST1                                                                                        ; 10      ;
; counter10:inst|count[1]~72                                                                  ; 8       ;
; counter10:inst|count[0]~69                                                                  ; 8       ;
; counter10:inst|count[3]~70                                                                  ; 8       ;
; counter6:inst3|count[2]~70                                                                  ; 8       ;
; counter10:inst2|count[3]~69                                                                 ; 8       ;
; counter10:inst2|count[0]~70                                                                 ; 8       ;
; counter10:inst2|count[1]~72                                                                 ; 8       ;
; counter6:inst1|count[2]~70                                                                  ; 8       ;
; counter7:inst6|count[0]~87                                                                  ; 7       ;
; counter10:inst|count[2]~71                                                                  ; 7       ;
; counter10:inst2|count[2]~71                                                                 ; 7       ;
; counter6:inst3|count[0]~71                                                                  ; 7       ;
; counter6:inst3|count[3]~72                                                                  ; 7       ;
; counter6:inst1|count[3]~72                                                                  ; 7       ;
; counter6:inst1|count[1]~73                                                                  ; 7       ;
; counter6:inst1|count[0]~71                                                                  ; 7       ;
; counter6:inst3|count[1]~73                                                                  ; 7       ;
; counter6:inst3|c~0                                                                          ; 7       ;
; counter7:inst6|count[2]~85                                                                  ; 6       ;
; CLK5                                                                                        ; 6       ;
; clk_div:inst22|clk1_1~1                                                                     ; 6       ;
; counter7:inst6|count[1]~86                                                                  ; 6       ;
; counter24:inst5|lpm_counter:count_rtl_0|alt_counter_f10ke:wysi_counter|q[3]~0               ; 6       ;
; counter24:inst5|lpm_counter:count_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 6       ;
; counter24:inst5|lpm_counter:count_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 6       ;
; zhongbai:inst30|q1~849                                                                      ; 6       ;
; zhongbai:inst30|Equal1~13                                                                   ; 6       ;
; counter10:inst|c~0                                                                          ; 5       ;
; c7:inst46|count[3]~77                                                                       ; 5       ;
; c7:inst46|count[2]~74                                                                       ; 5       ;
; c7:inst46|count[1]~75                                                                       ; 5       ;
; c7:inst46|count[0]~76                                                                       ; 5       ;
; c10:inst40|count[0]~63                                                                      ; 5       ;
; c10:inst42|count[0]~63                                                                      ; 5       ;
; c6:inst41|count[0]~61                                                                       ; 5       ;
; c6:inst43|count[0]~61                                                                       ; 5       ;
; counter10:inst2|c~0                                                                         ; 5       ;
; zhongbai:inst30|Equal0~78                                                                   ; 5       ;
; counter24:inst5|count[4]~78                                                                 ; 5       ;
; counter6:inst1|c~0                                                                          ; 5       ;
; counter7:inst6|count[3]~88                                                                  ; 5       ;
; zhongbai:inst30|q1[2]~845                                                                   ; 4       ;
; zhongbai:inst30|q1[3]~844                                                                   ; 4       ;
; zhongbai:inst30|q1[5]~842                                                                   ; 4       ;
; CLK6                                                                                        ; 4       ;
; c24:inst4|lpm_counter:count_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT       ; 4       ;
; c24:inst4|count[4]~73                                                                       ; 4       ;
+---------------------------------------------------------------------------------------------+---------+


+--------------------------------------------------------------------------------------------------+
; Peripheral Signals                                                                               ;
+-----------------------+---------+-------+-----------------+---------------------------+----------+
; Peripheral Signal     ; Source  ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-----------------------+---------+-------+-----------------+---------------------------+----------+
; clk_div:inst22|clk2_2 ; LC1_H16 ; Clock ; no              ; yes                       ; +ve      ;
+-----------------------+---------+-------+-----------------+---------------------------+----------+


+-------------------------------------------+
; LAB                                       ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0                        ; 597            ;
; 1                        ; 6              ;
; 2                        ; 2              ;
; 3                        ; 0              ;
; 4                        ; 1              ;
; 5                        ; 2              ;
; 6                        ; 3              ;
; 7                        ; 4              ;
; 8                        ; 9              ;
+--------------------------+----------------+


+----------------------------------------------+
; Local Routing Interconnect                   ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0                           ; 604            ;
; 1                           ; 1              ;
; 2                           ; 0              ;
; 3                           ; 3              ;
; 4                           ; 5              ;
; 5                           ; 2              ;
; 6                           ; 4              ;
; 7                           ; 2              ;
; 8                           ; 3              ;
+-----------------------------+----------------+


+---------------------------------------------+
; LAB External Interconnect                   ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0                          ; 600            ;
; 1                          ; 2              ;
; 2                          ; 4              ;
; 3                          ; 4              ;
; 4                          ; 2              ;
; 5                          ; 2              ;
; 6                          ; 5              ;
; 7                          ; 4              ;
; 8                          ; 0              ;
; 9                          ; 0              ;
; 10                         ; 0              ;
; 11                         ; 1              ;
+----------------------------+----------------+


+-----------------------------------------------------------------------------------------+
; Row Interconnect                                                                        ;
+-------+--------------------+-----------------------------+------------------------------+
; Row   ; Interconnect Used  ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+--------------------+-----------------------------+------------------------------+
;  A    ;  4 / 208 ( 2 % )   ;  1 / 104 ( < 1 % )          ;  0 / 104 ( 0 % )             ;
;  B    ;  14 / 208 ( 7 % )  ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  C    ;  4 / 208 ( 2 % )   ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  D    ;  1 / 208 ( < 1 % ) ;  0 / 104 ( 0 % )            ;  2 / 104 ( 2 % )             ;
;  E    ;  7 / 208 ( 3 % )   ;  6 / 104 ( 6 % )            ;  2 / 104 ( 2 % )             ;
;  F    ;  3 / 208 ( 1 % )   ;  3 / 104 ( 3 % )            ;  7 / 104 ( 7 % )             ;
;  G    ;  8 / 208 ( 4 % )   ;  10 / 104 ( 10 % )          ;  2 / 104 ( 2 % )             ;
;  H    ;  3 / 208 ( 1 % )   ;  2 / 104 ( 2 % )            ;  0 / 104 ( 0 % )             ;
;  I    ;  15 / 208 ( 7 % )  ;  1 / 104 ( < 1 % )          ;  9 / 104 ( 9 % )             ;
;  J    ;  1 / 208 ( < 1 % ) ;  0 / 104 ( 0 % )            ;  2 / 104 ( 2 % )             ;
;  K    ;  7 / 208 ( 3 % )   ;  5 / 104 ( 5 % )            ;  1 / 104 ( < 1 % )           ;
;  L    ;  1 / 208 ( < 1 % ) ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
; Total ;  68 / 2496 ( 3 % ) ;  28 / 1248 ( 2 % )          ;  25 / 1248 ( 2 % )           ;
+-------+--------------------+-----------------------------+------------------------------+


+----------------------------+
; LAB Column Interconnect    ;
+-------+--------------------+
; Col.  ; Interconnect Used  ;
+-------+--------------------+
; 1     ;  0 / 24 ( 0 % )    ;
; 2     ;  0 / 24 ( 0 % )    ;
; 3     ;  0 / 24 ( 0 % )    ;
; 4     ;  0 / 24 ( 0 % )    ;
; 5     ;  0 / 24 ( 0 % )    ;
; 6     ;  0 / 24 ( 0 % )    ;
; 7     ;  0 / 24 ( 0 % )    ;
; 8     ;  0 / 24 ( 0 % )    ;
; 9     ;  0 / 24 ( 0 % )    ;
; 10    ;  0 / 24 ( 0 % )    ;
; 11    ;  0 / 24 ( 0 % )    ;
; 12    ;  4 / 24 ( 17 % )   ;
; 13    ;  1 / 24 ( 4 % )    ;
; 14    ;  0 / 24 ( 0 % )    ;
; 15    ;  2 / 24 ( 8 % )    ;

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