📄 serial.fit.rpt
字号:
; led[4] ; Output ; -- ;
; led[3] ; Output ; -- ;
; led[2] ; Output ; -- ;
; led[1] ; Output ; -- ;
; led[0] ; Output ; -- ;
+---------+----------+---------------+
+-----------------------------------------------------------------------------------------------------------------------------+
; Control Signals ;
+----------------------------------+--------------+---------+--------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+----------------------------------+--------------+---------+--------------+--------+----------------------+------------------+
; clk ; PIN_18 ; 17 ; Clock ; yes ; Global clock ; GCLK0 ;
; reset ; PIN_93 ; 55 ; Async. clear ; yes ; Global clock ; GCLK3 ;
; serial_test:inst|clkbaud8x ; LC_X10_Y6_N9 ; 39 ; Clock ; yes ; Global clock ; GCLK2 ;
; serial_test:inst|rxd_buf[7]~255 ; LC_X1_Y5_N8 ; 8 ; Clock enable ; no ; -- ; -- ;
; serial_test:inst|txd_buf[2]~2393 ; LC_X14_Y8_N6 ; 6 ; Clock enable ; no ; -- ; -- ;
+----------------------------------+--------------+---------+--------------+--------+----------------------+------------------+
+-----------------------------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+----------------------------+--------------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+----------------------------+--------------+---------+----------------------+------------------+
; clk ; PIN_18 ; 17 ; Global clock ; GCLK0 ;
; reset ; PIN_93 ; 55 ; Global clock ; GCLK3 ;
; serial_test:inst|clkbaud8x ; LC_X10_Y6_N9 ; 39 ; Global clock ; GCLK2 ;
+----------------------------+--------------+---------+----------------------+------------------+
+---------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------------------+---------+
; Name ; Fan-Out ;
+-----------------------------------+---------+
; serial_test:inst|state_tras[1] ; 16 ;
; serial_test:inst|state_tras[2] ; 14 ;
; serial_test:inst|state_tras[3] ; 14 ;
; serial_test:inst|state_tras[0] ; 12 ;
; serial_test:inst|Equal~275 ; 10 ;
; serial_test:inst|state_rec[0] ; 9 ;
; serial_test:inst|trasstart ; 9 ;
; serial_test:inst|send_state[1] ; 9 ;
; serial_test:inst|rxd_buf[7]~255 ; 8 ;
; serial_test:inst|send_state[2] ; 8 ;
; serial_test:inst|txd_buf[2]~2393 ; 6 ;
; serial_test:inst|state_rec[3] ; 6 ;
; serial_test:inst|state_rec[1] ; 6 ;
; serial_test:inst|send_state[0] ; 6 ;
; serial_test:inst|add~670 ; 5 ;
; serial_test:inst|add~645 ; 5 ;
; serial_test:inst|Equal~281 ; 5 ;
; serial_test:inst|txd_buf[2]~2386 ; 5 ;
; serial_test:inst|state_rec[2] ; 5 ;
; serial_test:inst|div8_rec_reg[0] ; 5 ;
; serial_test:inst|div8_tras_reg[0] ; 5 ;
; serial_test:inst|state_rec~868 ; 4 ;
; serial_test:inst|recstart ; 4 ;
; serial_test:inst|div8_rec_reg[1] ; 4 ;
; serial_test:inst|div8_tras_reg[1] ; 4 ;
; serial_test:inst|add~615 ; 3 ;
; serial_test:inst|state_rec[1]~867 ; 3 ;
; serial_test:inst|recstart_tmp ; 3 ;
; serial_test:inst|Equal~282 ; 3 ;
; serial_test:inst|Mux~2289 ; 3 ;
; serial_test:inst|Mux~2284 ; 3 ;
; serial_test:inst|Equal~276 ; 3 ;
; serial_test:inst|div8_rec_reg[2] ; 3 ;
; serial_test:inst|txd_reg~769 ; 3 ;
; serial_test:inst|div8_tras_reg[2] ; 3 ;
; serial_test:inst|txd_reg ; 3 ;
; serial_test:inst|txd_buf[4] ; 2 ;
; serial_test:inst|txd_buf[3] ; 2 ;
; serial_test:inst|Mux~2294 ; 2 ;
; serial_test:inst|state_rec[1]~866 ; 2 ;
; serial_test:inst|state_rec[1]~865 ; 2 ;
; serial_test:inst|rxd_reg1 ; 2 ;
; serial_test:inst|div_reg[0] ; 2 ;
; serial_test:inst|div_reg[1] ; 2 ;
; serial_test:inst|div_reg[3] ; 2 ;
; serial_test:inst|div_reg[5] ; 2 ;
; serial_test:inst|div_reg[6] ; 2 ;
; serial_test:inst|div_reg[4] ; 2 ;
; serial_test:inst|div_reg[8] ; 2 ;
; serial_test:inst|div_reg[9] ; 2 ;
+-----------------------------------+---------+
+---------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+----------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+----------------------+
; C4s ; 32 / 2,870 ( 1 % ) ;
; Direct links ; 61 / 3,938 ( 2 % ) ;
; Global clocks ; 3 / 4 ( 75 % ) ;
; LAB clocks ; 17 / 72 ( 24 % ) ;
; LUT chains ; 11 / 1,143 ( < 1 % ) ;
; Local interconnects ; 120 / 3,938 ( 3 % ) ;
; R4s ; 25 / 2,832 ( < 1 % ) ;
+----------------------------+----------------------+
+---------------------------------------------------------------------------+
; LAB Logic Elements ;
+--------------------------------------------+------------------------------+
; Number of Logic Elements (Average = 6.94) ; Number of LABs (Total = 16) ;
+--------------------------------------------+------------------------------+
; 1 ; 2 ;
; 2 ; 1 ;
; 3 ; 0 ;
; 4 ; 3 ;
; 5 ; 1 ;
; 6 ; 0 ;
; 7 ; 0 ;
; 8 ; 0 ;
; 9 ; 0 ;
; 10 ; 9 ;
+--------------------------------------------+------------------------------+
+-------------------------------------------------------------------+
; LAB-wide Signals ;
+------------------------------------+------------------------------+
; LAB-wide Signals (Average = 2.00) ; Number of LABs (Total = 16) ;
+------------------------------------+------------------------------+
; 1 Async. clear ; 15 ;
; 1 Clock ; 15 ;
; 1 Clock enable ; 2 ;
+------------------------------------+------------------------------+
+----------------------------------------------------------------------------+
; LAB Signals Sourced ;
+---------------------------------------------+------------------------------+
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