📄 tt.sim.rpt
字号:
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~24 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~24 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~25 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~25 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~26 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~26 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~27 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~27 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~28 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~28 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~34 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~34 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~35 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~35 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~36 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~36 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~37 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~37 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~38 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~38 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[10] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[10] ; sout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[9] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[9] ; cout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[9] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[9] ; sout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[8] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[8] ; cout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[8] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[8] ; sout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[7] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[7] ; cout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[7] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[7] ; sout ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[6] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[6] ; cout ;
+----------------------------------------------------------------------------------+----------------------------------------------------------------------------------+------------------+
The following table displays output ports that do not toggle to 0 during simulation.
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Missing 0-Value Coverage ;
+----------------------------------------------------------------------------------+----------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+----------------------------------------------------------------------------------+----------------------------------------------------------------------------------+------------------+
; |ADC_TLC549|readdata~1 ; |ADC_TLC549|readdata~1 ; out ;
; |ADC_TLC549|readdata~3 ; |ADC_TLC549|readdata~3 ; out ;
; |ADC_TLC549|readdata~5 ; |ADC_TLC549|readdata~5 ; out ;
; |ADC_TLC549|readdata~7 ; |ADC_TLC549|readdata~7 ; out ;
; |ADC_TLC549|DCLK_DIV~0 ; |ADC_TLC549|DCLK_DIV~0 ; out ;
; |ADC_TLC549|DCLK_DIV~1 ; |ADC_TLC549|DCLK_DIV~1 ; out ;
; |ADC_TLC549|DCLK_DIV~2 ; |ADC_TLC549|DCLK_DIV~2 ; out ;
; |ADC_TLC549|DCLK_DIV~3 ; |ADC_TLC549|DCLK_DIV~3 ; out ;
; |ADC_TLC549|data_temp[0] ; |ADC_TLC549|data_temp[0] ; regout ;
; |ADC_TLC549|data_temp[2] ; |ADC_TLC549|data_temp[2] ; regout ;
; |ADC_TLC549|data_temp[4] ; |ADC_TLC549|data_temp[4] ; regout ;
; |ADC_TLC549|data_temp[6] ; |ADC_TLC549|data_temp[6] ; regout ;
; |ADC_TLC549|DCLK_DIV[6] ; |ADC_TLC549|DCLK_DIV[6] ; regout ;
; |ADC_TLC549|DCLK_DIV[7] ; |ADC_TLC549|DCLK_DIV[7] ; regout ;
; |ADC_TLC549|DCLK_DIV[8] ; |ADC_TLC549|DCLK_DIV[8] ; regout ;
; |ADC_TLC549|DCLK_DIV[9] ; |ADC_TLC549|DCLK_DIV[9] ; regout ;
; |ADC_TLC549|DCLK_DIV[10] ; |ADC_TLC549|DCLK_DIV[10] ; regout ;
; |ADC_TLC549|read_n ; |ADC_TLC549|read_n ; out ;
; |ADC_TLC549|readdata[0] ; |ADC_TLC549|readdata[0] ; pin_out ;
; |ADC_TLC549|readdata[2] ; |ADC_TLC549|readdata[2] ; pin_out ;
; |ADC_TLC549|readdata[4] ; |ADC_TLC549|readdata[4] ; pin_out ;
; |ADC_TLC549|readdata[6] ; |ADC_TLC549|readdata[6] ; pin_out ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[0]~0 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[0]~0 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[0] ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[0] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~1 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~1 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~2 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~2 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[4]~1 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[4]~1 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[4] ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[4] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[3] ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[3] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[2] ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[2] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[1] ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|datab_node[1] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~4 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~4 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~5 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~5 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~6 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~6 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~7 ; |ADC_TLC549|lpm_add_sub:Add1|addcore:adder|_~7 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|result_node[7] ; |ADC_TLC549|lpm_add_sub:Add0|result_node[7] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|result_node[8] ; |ADC_TLC549|lpm_add_sub:Add0|result_node[8] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|result_node[9] ; |ADC_TLC549|lpm_add_sub:Add0|result_node[9] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|result_node[10] ; |ADC_TLC549|lpm_add_sub:Add0|result_node[10] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[0]~0 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[0]~0 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[0] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[0] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~1 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~1 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~2 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|_~2 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[10]~1 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[10]~1 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[10] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[10] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[9] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[9] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[8] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[8] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[7] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[7] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[6] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[6] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[5] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[5] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[4] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[4] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[3] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[3] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[2] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[2] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[1] ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|datab_node[1] ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[10]~1 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[10]~1 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[9]~2 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[9]~2 ; out0 ;
; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[8]~3 ; |ADC_TLC549|lpm_add_sub:Add0|addcore:adder|unreg_res_node[8]~3 ; out0 ;
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