smallcore.fit.rpt
来自「MagicSopc DDR-Sdram」· RPT 代码 · 共 414 行 · 第 1/5 页
RPT
414 行
; -- 4 input functions ; 963 ;
; -- 3 input functions ; 689 ;
; -- <=2 input functions ; 394 ;
; -- Register only ; 370 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 1817 ;
; -- arithmetic mode ; 229 ;
; ; ;
; Total registers* ; 1,533 / 34,593 ( 4 % ) ;
; -- Dedicated logic registers ; 1,516 / 33,216 ( 5 % ) ;
; -- I/O registers ; 17 / 1,377 ( 1 % ) ;
; ; ;
; Total LABs: partially or completely used ; 210 / 2,076 ( 10 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 55 / 475 ( 12 % ) ;
; -- Clock pins ; 2 / 8 ( 25 % ) ;
; Global signals ; 13 ;
; M4Ks ; 7 / 105 ( 7 % ) ;
; Total memory bits ; 11,392 / 483,840 ( 2 % ) ;
; Total RAM block bits ; 32,256 / 483,840 ( 7 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 1 / 4 ( 25 % ) ;
; Global clocks ; 13 / 16 ( 81 % ) ;
; Average interconnect usage ; 3% ;
; Peak interconnect usage ; 13% ;
; Maximum fan-out node ; nios2e_2C35:inst1|nios2e_2C35_reset_clk_domain_synch_module:nios2e_2C35_reset_clk_domain_synch|data_out~clkctrl ;
; Maximum fan-out ; 1236 ;
; Highest non-global fan-out signal ; nios2e_2C35:inst1|cpu:the_cpu|cpu_nios2_oci:the_cpu_nios2_oci|cpu_nios2_oci_break:the_cpu_nios2_oci_break|break_readreg[29]~2162 ;
; Highest non-global fan-out ; 64 ;
; Total fan-out ; 13228 ;
; Average fan-out ; 3.34 ;
+---------------------------------------------+----------------------------------------------------------------------------------------------------------------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; SYS_CLK ; B13 ; 4 ; 31 ; 36 ; 0 ; 2 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SYS_nRST ; AC13 ; 8 ; 33 ; 0 ; 3 ; 2 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+----------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+----------------+------------------+-------------+----------------------+------+
; LED[0] ; R5 ; 1 ; 0 ; 16 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[1] ; P9 ; 2 ; 0 ; 25 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[2] ; P7 ; 1 ; 0 ; 15 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[3] ; P6 ; 1 ; 0 ; 15 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[4] ; P3 ; 1 ; 0 ; 17 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[5] ; R8 ; 1 ; 0 ; 7 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[6] ; R6 ; 1 ; 0 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; LED[7] ; T3 ; 1 ; 0 ; 15 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; SDRAM_A[0] ; E24 ; 5 ; 65 ; 33 ; 4 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[10] ; F23 ; 5 ; 65 ; 30 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[11] ; G22 ; 5 ; 65 ; 33 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[1] ; C25 ; 5 ; 65 ; 32 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[2] ; J25 ; 5 ; 65 ; 24 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[3] ; G26 ; 5 ; 65 ; 27 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[4] ; F24 ; 5 ; 65 ; 30 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[5] ; G23 ; 5 ; 65 ; 28 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[6] ; F25 ; 5 ; 65 ; 29 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[7] ; F26 ; 5 ; 65 ; 29 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[8] ; H19 ; 5 ; 65 ; 26 ; 4 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_A[9] ; K18 ; 5 ; 65 ; 25 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_BA[0] ; D23 ; 5 ; 65 ; 34 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_BA[1] ; C24 ; 5 ; 65 ; 32 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_CAS_n ; E25 ; 5 ; 65 ; 31 ; 4 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_CKE ; D25 ; 5 ; 65 ; 31 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 0 pF ;
; SDRAM_CLK ; F21 ; 5 ; 65 ; 34 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 0 pF ;
; SDRAM_CS_n ; E23 ; 5 ; 65 ; 33 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 0 pF ;
; SDRAM_DM[0] ; M25 ; 5 ; 65 ; 20 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 4 pF ;
; SDRAM_DM[1] ; K24 ; 5 ; 65 ; 25 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 4 pF ;
; SDRAM_RAS_n ; D26 ; 5 ; 65 ; 31 ; 0 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
; SDRAM_WE_n ; E26 ; 5 ; 65 ; 31 ; 3 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; SSTL-2 Class I ; 12mA ; Off ; User ; 2 pF ;
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