uart.fit.rpt

在ＶＨＤＬ上编写了UART通信协议

; Auto Global Memory Control Signals                   ; Off                            ; Off                            ;
; Auto Packed Registers -- Stratix/Stratix GX          ; Auto                           ; Auto                           ;
; Auto Delay Chains                                    ; On                             ; On                             ;
; Auto Merge PLLs                                      ; On                             ; On                             ;
; Perform Physical Synthesis for Combinational Logic   ; Off                            ; Off                            ;
; Perform Register Duplication                         ; Off                            ; Off                            ;
; Perform Register Retiming                            ; Off                            ; Off                            ;
; Perform Asynchronous Signal Pipelining               ; Off                            ; Off                            ;
; Fitter Effort                                        ; Auto Fit                       ; Auto Fit                       ;
; Physical Synthesis Effort Level                      ; Normal                         ; Normal                         ;
; Logic Cell Insertion - Logic Duplication             ; Auto                           ; Auto                           ;
; Auto Register Duplication                            ; Off                            ; Off                            ;
; Auto Global Clock                                    ; On                             ; On                             ;
; Auto Global Register Control Signals                 ; On                             ; On                             ;
+------------------------------------------------------+--------------------------------+--------------------------------+


+-------------------------------------------------------------------------+
; Fitter Device Options                                                   ;
+----------------------------------------------+--------------------------+
; Option                                       ; Setting                  ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off                      ;
; Enable device-wide reset (DEV_CLRn)          ; Off                      ;
; Enable device-wide output enable (DEV_OE)    ; Off                      ;
; Enable INIT_DONE output                      ; Off                      ;
; Configuration scheme                         ; Passive Serial           ;
; Error detection CRC                          ; Off                      ;
; Reserve Data[0] pin after configuration      ; As input tri-stated      ;
; Reserve all unused pins                      ; As output driving ground ;
; Base pin-out file on sameframe device        ; Off                      ;
+----------------------------------------------+--------------------------+


+--------------------------------------------------------------------------------------------------------------+
; Fitter Netlist Optimizations                                                                                 ;
+---------+---------+------------------+---------------------+-----------+------------------+------------------+
; Node    ; Action  ; Operation        ; Reason              ; Node Port ; Destination Node ; Destination Port ;
+---------+---------+------------------+---------------------+-----------+------------------+------------------+
; rtl~219 ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                  ;                  ;
; txd~32  ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                  ;                  ;
+---------+---------+------------------+---------------------+-----------+------------------+------------------+


+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in C:/mywork/04058095/UART/UART.fit.eqn.


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/mywork/04058095/UART/UART.pin.


+---------------------------------------------------------------------+
; Fitter Resource Usage Summary                                       ;
+---------------------------------------------+-----------------------+
; Resource                                    ; Usage                 ;
+---------------------------------------------+-----------------------+
; Total logic elements                        ; 92 / 10,570 ( < 1 % ) ;
;     -- Combinational with no register       ; 38                    ;
;     -- Register only                        ; 11                    ;
;     -- Combinational with a register        ; 43                    ;
;                                             ;                       ;
; Logic element usage by number of LUT inputs ;                       ;
;     -- 4 input functions                    ; 47                    ;
;     -- 3 input functions                    ; 23                    ;
;     -- 2 input functions                    ; 11                    ;
;     -- 1 input functions                    ; 5                     ;
;     -- 0 input functions                    ; 6                     ;
;                                             ;                       ;
; Logic elements by mode                      ;                       ;
;     -- normal mode                          ; 89                    ;
;     -- arithmetic mode                      ; 3                     ;
;     -- qfbk mode                            ; 7                     ;
;     -- register cascade mode                ; 0                     ;
;     -- synchronous clear/load mode          ; 17                    ;
;     -- asynchronous clear/load mode         ; 35                    ;
;                                             ;                       ;
; Total LABs                                  ; 14 / 1,057 ( 1 % )    ;
; Logic elements in carry chains              ; 4                     ;
; User inserted logic elements                ; 0                     ;
; Virtual pins                                ; 0                     ;
; I/O pins                                    ; 20 / 336 ( 6 % )      ;
;     -- Clock pins                           ; 4 / 16 ( 25 % )       ;
; Global signals                              ; 4                     ;
; M512s                                       ; 0 / 94 ( 0 % )        ;
; M4Ks                                        ; 0 / 60 ( 0 % )        ;
; M-RAMs                                      ; 0 / 1 ( 0 % )         ;
; Total memory bits                           ; 0 / 920,448 ( 0 % )   ;
; Total RAM block bits                        ; 0 / 920,448 ( 0 % )   ;
; DSP block 9-bit elements                    ; 0 / 48 ( 0 % )        ;
; PLLs                                        ; 0 / 6 ( 0 % )         ;
; Global clocks                               ; 4 / 16 ( 25 % )       ;
; Regional clocks                             ; 0 / 16 ( 0 % )        ;
; Fast regional clocks                        ; 0 / 8 ( 0 % )         ;
; SERDES transmitters                         ; 0 / 44 ( 0 % )        ;
; SERDES receivers                            ; 0 / 44 ( 0 % )        ;