ram_single_port_128x8.tlg

来自「学习Xilinx公司开发软件ISE的基础资料」· TLG 代码 · 共 4 行

TLG
4 行
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Selecting top level module ram_single_port_128x8
Synthesizing module ram_single_port_128x8
@N: CL134 :"D:\CD\hdl_example_v2_synplify\spro_703\verilog\ram\default\ram_single_port_128x8.v":60:11:60:19|Found RAM mem, depth=128, width=8

ram_single_port_128x8.tlg - 源码说明

本页面展示了「学习Xilinx公司开发软件ISE的基础资料」中的 ram_single_port_128x8.tlg 源码文件，采用 TLG 编程语言编写，共 4 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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