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📄 standard.pin

📁 郑亚民版的可编程逻辑器件开发软件quatus ii里的一些例程
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GND                          : K10       : gnd    :                   :         :           :                
VCCIO3                       : K11       : power  :                   : 3.3V    : 3         :                
P0[21]                       : K12       : bidir  : LVTTL             :         : 3         : Y              
CONF_DONE                    : K13       :        :                   :         : 3         :                
P0[22]                       : K14       : bidir  : LVTTL             :         : 3         : Y              
P2[23]                       : K15       : bidir  : LVTTL             :         : 3         : Y              
P2[24]                       : K16       : bidir  : LVTTL             :         : 3         : Y              
SDRAM_D[7]                   : L1        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[6]                   : L2        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[9]                   : L3        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[8]                   : L4        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[10]                  : L5        : bidir  : LVTTL             :         : 1         : Y              
GND                          : L6        : gnd    :                   :         :           :                
VCCIO4                       : L7        : power  :                   : 3.3V    : 4         :                
GND                          : L8        : gnd    :                   :         :           :                
GND                          : L9        : gnd    :                   :         :           :                
VCCIO4                       : L10       : power  :                   : 3.3V    : 4         :                
GND                          : L11       : gnd    :                   :         :           :                
P0[11]                       : L12       : bidir  : LVTTL             :         : 3         : Y              
P0[19]                       : L13       : bidir  : LVTTL             :         : 3         : Y              
P0[20]                       : L14       : bidir  : LVTTL             :         : 3         : Y              
P2[21]                       : L15       : bidir  : LVTTL             :         : 3         : Y              
P2[22]                       : L16       : bidir  : LVTTL             :         : 3         : Y              
SDRAM_D[5]                   : M1        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[4]                   : M2        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[11]                  : M3        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[12]                  : M4        : bidir  : LVTTL             :         : 1         : Y              
NF_D[3]                      : M5        : bidir  : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : M6        :        :                   :         : 4         :                
RESERVED_INPUT               : M7        :        :                   :         : 4         :                
NF_D[6]                      : M8        : bidir  : LVTTL             :         : 4         : Y              
P0_0_TXD                     : M9        : output : LVTTL             :         : 4         : Y              
P0_5_MISO                    : M10       : input  : LVTTL             :         : 4         : Y              
P0[9]                        : M11       : bidir  : LVTTL             :         : 4         : Y              
P0[10]                       : M12       : bidir  : LVTTL             :         : 4         : Y              
P0[17]                       : M13       : bidir  : LVTTL             :         : 3         : Y              
P0[18]                       : M14       : bidir  : LVTTL             :         : 3         : Y              
P2[19]                       : M15       : bidir  : LVTTL             :         : 3         : Y              
P2[20]                       : M16       : bidir  : LVTTL             :         : 3         : Y              
SDRAM_D[3]                   : N1        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[2]                   : N2        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[13]                  : N3        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[14]                  : N4        : bidir  : LVTTL             :         : 1         : Y              
RESERVED_INPUT               : N5        :        :                   :         : 4         :                
NF_D[5]                      : N6        : bidir  : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : N7        :        :                   :         : 4         :                
NF_D[7]                      : N8        : bidir  : LVTTL             :         : 4         : Y              
P0_1_RXD                     : N9        : input  : LVTTL             :         : 4         : Y              
SDA                          : N10       : bidir  : LVTTL             :         : 4         : Y              
P0[24]                       : N11       : bidir  : LVTTL             :         : 4         : N              
P0[12]                       : N12       : bidir  : LVTTL             :         : 4         : Y              
P0[15]                       : N13       : bidir  : LVTTL             :         : 3         : Y              
P0[16]                       : N14       : bidir  : LVTTL             :         : 3         : Y              
P2[17]                       : N15       : bidir  : LVTTL             :         : 3         : Y              
P2[18]                       : N16       : bidir  : LVTTL             :         : 3         : Y              
VCCIO1                       : P1        : power  :                   : 3.3V    : 1         :                
SDRAM_D[1]                   : P2        : bidir  : LVTTL             :         : 1         : Y              
SDRAM_D[15]                  : P3        : bidir  : LVTTL             :         : 1         : Y              
NF_A[1]                      : P4        : output : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : P5        :        :                   :         : 4         :                
NF_D[4]                      : P6        : bidir  : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : P7        :        :                   :         : 4         :                
RESERVED_INPUT               : P8        :        :                   :         : 4         :                
SCL                          : P9        : bidir  : LVTTL             :         : 4         : Y              
P0_4_CLK                     : P10       : output : LVTTL             :         : 4         : Y              
P0_6_MOSI                    : P11       : output : LVTTL             :         : 4         : Y              
P0[8]                        : P12       : bidir  : LVTTL             :         : 4         : Y              
P0[14]                       : P13       : bidir  : LVTTL             :         : 4         : Y              
P0[13]                       : P14       : bidir  : LVTTL             :         : 3         : Y              
P2[16]                       : P15       : bidir  : LVTTL             :         : 3         : Y              
VCCIO3                       : P16       : power  :                   : 3.3V    : 3         :                
SDRAM_D[0]                   : R1        : bidir  : LVTTL             :         : 1         : Y              
NF_nBUSY                     : R2        : input  : LVTTL             :         : 4         : Y              
NF_nCS                       : R3        : output : LVTTL             :         : 4         : Y              
NF_nWE                       : R4        : output : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : R5        :        :                   :         : 4         :                
RESERVED_INPUT               : R6        :        :                   :         : 4         :                
NF_D[0]                      : R7        : bidir  : LVTTL             :         : 4         : Y              
NF_D[2]                      : R8        : bidir  : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : R9        :        :                   :         : 4         :                
P1[16]                       : R10       : bidir  : LVTTL             :         : 4         : Y              
P1[18]                       : R11       : bidir  : LVTTL             :         : 4         : Y              
P1[19]                       : R12       : bidir  : LVTTL             :         : 4         : Y              
P1[21]                       : R13       : bidir  : LVTTL             :         : 4         : Y              
P1[22]                       : R14       : bidir  : LVTTL             :         : 4         : Y              
P1[24]                       : R15       : bidir  : LVTTL             :         : 4         : Y              
P1[25]                       : R16       : bidir  : LVTTL             :         : 3         : Y              
GND                          : T1        : gnd    :                   :         :           :                
NF_nOE                       : T2        : output : LVTTL             :         : 4         : Y              
VCCIO4                       : T3        : power  :                   : 3.3V    : 4         :                
NF_A[0]                      : T4        : output : LVTTL             :         : 4         : Y              
GND                          : T5        : gnd    :                   :         :           :                
RESERVED_INPUT               : T6        :        :                   :         : 4         :                
VCCINT                       : T7        : power  :                   : 1.5V    :           :                
NF_D[1]                      : T8        : bidir  : LVTTL             :         : 4         : Y              
RESERVED_INPUT               : T9        :        :                   :         : 4         :                
VCCINT                       : T10       : power  :                   : 1.5V    :           :                
P1[17]                       : T11       : bidir  : LVTTL             :         : 4         : Y              
GND                          : T12       : gnd    :                   :         :           :                
P1[20]                       : T13       : bidir  : LVTTL             :         : 4         : Y              
VCCIO4                       : T14       : power  :                   : 3.3V    : 4         :                
P1[23]                       : T15       : bidir  : LVTTL             :         : 4         : Y              
GND                          : T16       : gnd    :                   :         :           :                

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