📄 ddr2_v340_ecc.map.rpt
字号:
; -- shared arithmetic mode ; 0 ;
; ; ;
; Estimated ALUT/register pairs used ; 1533 ;
; ; ;
; Total registers ; 2136 ;
; -- Dedicated logic registers ; 1533 ;
; -- I/O registers ; 603 ;
; ; ;
; Estimated ALMs: partially or completely used ; 767 ;
; ; ;
; I/O pins ; 140 ;
; Total block memory bits ; 2592 ;
; Total PLLs ; 1 ;
; Total DLLs ; 1 ;
; Maximum fan-out node ; ddr_pll_stratixii:g_stratixpll_ddr_pll_inst|altpll:altpll_component|_clk0 ;
; Maximum fan-out ; 1792 ;
; Total fan-out ; 11751 ;
; Average fan-out ; 3.98 ;
+-----------------------------------------------+---------------------------------------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+--------------------------------------------------------------------+-------------------+--------------+-------------------+--------------+---------+-----------+-----------+------+--------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; LC Combinationals ; LC Registers ; Block Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; DSP 36x36 ; Pins ; Virtual Pins ; Full Hierarchy Name ;
+--------------------------------------------------------------------+-------------------+--------------+-------------------+--------------+---------+-----------+-----------+------+--------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |ddr2_v340_ecc ; 1117 (27) ; 1533 (26) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 140 ; 0 ; |ddr2_v340_ecc ;
; |ddr2_topecc:ddr2_topecc_ddr_sdram| ; 633 (0) ; 1248 (0) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 96 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram ;
; |ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst| ; 633 (0) ; 1248 (21) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 96 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst ;
; |auk_ddr_controller:ddr_control| ; 614 (282) ; 552 (244) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control ;
; |auk_ddr2_init:\g_ddr2_init:init_block| ; 67 (67) ; 41 (41) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr2_init:\g_ddr2_init:init_block ;
; |auk_ddr_bank_details:bank_man| ; 74 (74) ; 56 (56) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_bank_details:bank_man ;
; |auk_ddr_input_buf:in_buf| ; 100 (10) ; 127 (15) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_input_buf:in_buf ;
; |custom_fifo:my_fifo| ; 90 (90) ; 112 (112) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_input_buf:in_buf|custom_fifo:my_fifo ;
; |auk_ddr_timers:\g_timers:0:bank_timer| ; 16 (16) ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_timers:\g_timers:0:bank_timer ;
; |auk_ddr_timers:\g_timers:1:bank_timer| ; 16 (16) ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_timers:\g_timers:1:bank_timer ;
; |auk_ddr_timers:\g_timers:2:bank_timer| ; 16 (16) ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_timers:\g_timers:2:bank_timer ;
; |auk_ddr_timers:\g_timers:3:bank_timer| ; 16 (16) ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|auk_ddr_timers:\g_timers:3:bank_timer ;
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; |scfifo_e691:auto_generated| ; 27 (2) ; 20 (1) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|scfifo:\g_local_buffered_if:reg_wdata_fifo|scfifo_e691:auto_generated ;
; |a_dpfifo_7u11:dpfifo| ; 25 (14) ; 19 (8) ; 2592 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|scfifo:\g_local_buffered_if:reg_wdata_fifo|scfifo_e691:auto_generated|a_dpfifo_7u11:dpfifo ;
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; |cntr_bu8:rd_ptr_msb| ; 3 (3) ; 3 (3) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|scfifo:\g_local_buffered_if:reg_wdata_fifo|scfifo_e691:auto_generated|a_dpfifo_7u11:dpfifo|cntr_bu8:rd_ptr_msb ;
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; |cntr_qs7:usedw_counter| ; 4 (4) ; 4 (4) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |ddr2_v340_ecc|ddr2_topecc:ddr2_topecc_ddr_sdram|ddr2_topecc_auk_ddr_sdram:ddr2_topecc_auk_ddr_sdram_inst|auk_ddr_controller:ddr_control|scfifo:\g_local_buffered_if:reg_wdata_fifo|scfifo_e691:auto_generated|a_dpfifo_7u11:dpfifo|cntr_qs7:usedw_counter ;
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