📄 hello_gx.fit.rpt
字号:
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/Cyclone II ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Always Enable Input Buffers ; Off ; Off ;
+----------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/cvs_sandbox/boards/stratix2_gx/stratix2_gx_pciex/pld/hello_gx/hello_gx_restored/hello_gx.pin.
+------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+------------------------------------------------+-----------------------+
; Resource ; Usage ;
+------------------------------------------------+-----------------------+
; Total ALUTs ; 59 / 72,768 ( < 1 % ) ;
; -- ALUTs Used ; 59 ;
; -- Combinational with no register ; 9 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 50 ;
; -- ALUTs Unavailable ; 0 ;
; -- Due to unpartnered 7 input function ; 0 ;
; -- Due to unpartnered 6 input function ; 0 ;
; ; ;
; ALUT usage by number of inputs ; ;
; -- 7 input functions ; 0 ;
; -- 6 input functions ; 0 ;
; -- 5 input functions ; 0 ;
; -- 4 input functions ; 0 ;
; -- <=3 input functions ; 59 ;
; -- Register only ; 0 ;
; ; ;
; ALUTs without a partner ; 3 ;
; -- unpartnered 7 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered 6 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered 5 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered 4 input functions ; 0 / 0 ( 0 % ) ;
; -- unpartnered <=3 input functions ; 3 / 59 ( 5 % ) ;
; -- Unpartnered registers only ; 0 / 50 ( 0 % ) ;
; ; ;
; ALUTs by mode ; ;
; -- normal mode ; 11 ;
; -- extended LUT mode ; 0 ;
; -- arithmetic mode ; 48 ;
; -- shared arithmetic mode ; 0 ;
; ; ;
; Total registers ; 50 / 72,768 ( < 1 % ) ;
; ALMs: partially or completely used ; 31 / 36,384 ( < 1 % ) ;
; Total LABs ; 6 / 4,548 ( < 1 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 34 / 739 ( 5 % ) ;
; -- Clock pins ; 5 / 22 ( 23 % ) ;
; Global signals ; 2 ;
; M512s ; 0 / 488 ( 0 % ) ;
; M4Ks ; 0 / 408 ( 0 % ) ;
; M-RAMs ; 0 / 4 ( 0 % ) ;
; Total memory bits ; 0 / 4,520,448 ( 0 % ) ;
; Total RAM block bits ; 0 / 4,520,448 ( 0 % ) ;
; DSP block 9-bit elements ; 0 / 384 ( 0 % ) ;
; PLLs ; 0 / 8 ( 0 % ) ;
; Global clocks ; 2 / 16 ( 13 % ) ;
; Regional clocks ; 0 / 32 ( 0 % ) ;
; SERDES transmitters ; 0 / 59 ( 0 % ) ;
; SERDES receivers ; 0 / 59 ( 0 % ) ;
; GXB Receiver channels ; 0 / 16 ( 0 % ) ;
; GXB Transmitter channels ; 0 / 16 ( 0 % ) ;
; Maximum fan-out node ; clk2_p~clkctrl ;
; Maximum fan-out ; 25 ;
; Highest non-global fan-out signal ; pcie_led_x1~1 ;
; Highest non-global fan-out ; 11 ;
; Total fan-out ; 246 ;
; Average fan-out ; 1.68 ;
+------------------------------------------------+-----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk1_p ; A20 ; 4 ; 52 ; 69 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVDS ; Off ; User ;
; clk1_p(n) ; A21 ; 4 ; 52 ; 69 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVDS ; Off ; Fitter ;
; clk2_p ; AW22 ; 8 ; 40 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVDS ; Off ; User ;
; clk2_p(n) ; AV22 ; 8 ; 40 ; 0 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVDS ; Off ; Fitter ;
; user_dipsw[0] ; V36 ; 2 ; 0 ; 37 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 2.5 V ; Off ; User ;
; user_dipsw[1] ; V34 ; 2 ; 0 ; 41 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 2.5 V ; Off ; User ;
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