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📄 fir.fit.rpt

📁 VHDL设计FIR滤波器 基于QUARTUS和MATLAB
💻 RPT
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;      - dff8:inst2|Dout[0]~reg0    ; 0                 ; ON      ;
+-----------------------------------+-------------------+---------+


+------------------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                                        ;
+-------------------------------------------------------------------------------------------------------------------------
; Name                       ; Location      ; Fan-Out ; Usage        ; Global ; Global Resource Used ; Global Line Name ;
+----------------------------+---------------+---------+--------------+--------+----------------------+------------------+
; add889:inst18|Dout[8]~reg0 ; LC_X10_Y4_N8  ; 12      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst19|Dout[8]~reg0 ; LC_X11_Y6_N8  ; 12      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst20|Dout[8]~reg0 ; LC_X10_Y7_N8  ; 16      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst21|Dout[8]~reg0 ; LC_X9_Y10_N8  ; 19      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst22|Dout[8]~reg0 ; LC_X16_Y7_N8  ; 16      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst23|Dout[8]~reg0 ; LC_X17_Y7_N8  ; 16      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst24|Dout[8]~reg0 ; LC_X16_Y9_N8  ; 16      ; Sync. load   ; no     ; --                   ; --               ;
; add889:inst25|Dout[8]~reg0 ; LC_X15_Y11_N8 ; 17      ; Sync. load   ; no     ; --                   ; --               ;
; clear                      ; Pin_66        ; 152     ; Async. clear ; yes    ; Global clock         ; GCLK6            ;
; clk                        ; Pin_10        ; 435     ; Clock        ; yes    ; Global clock         ; GCLK2            ;
; dff89:inst34|Dout[8]~reg0  ; LC_X11_Y11_N4 ; 28      ; Sync. load   ; no     ; --                   ; --               ;
+----------------------------+---------------+---------+--------------+--------+----------------------+------------------+


+----------------------------------------------------------------------+
; Global & Other Fast Signals                                          ;
+-----------------------------------------------------------------------
; Name  ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+-------+----------+---------+----------------------+------------------+
; clear ; Pin_66   ; 152     ; Global clock         ; GCLK6            ;
; clk   ; Pin_10   ; 435     ; Global clock         ; GCLK2            ;
+-------+----------+---------+----------------------+------------------+


+--------------------------------------+
; Non-Global High Fan-Out Signals      ;
+---------------------------------------
; Name                       ; Fan-Out ;
+----------------------------+---------+
; dff89:inst34|Dout[8]~reg0  ; 29      ;
; add889:inst21|Dout[8]~reg0 ; 20      ;
; add889:inst25|Dout[8]~reg0 ; 18      ;
; add889:inst23|Dout[8]~reg0 ; 17      ;
; add889:inst20|Dout[8]~reg0 ; 17      ;
; add889:inst22|Dout[8]~reg0 ; 17      ;
; add889:inst24|Dout[8]~reg0 ; 17      ;
; add889:inst18|Dout[8]~reg0 ; 14      ;
; add889:inst19|Dout[8]~reg0 ; 14      ;
; dff89:inst34|Dout[3]~reg0  ; 12      ;
; dff89:inst34|Dout[4]~reg0  ; 12      ;
; dff89:inst34|Dout[5]~reg0  ; 12      ;
; dff89:inst34|Dout[6]~reg0  ; 12      ;
; dff89:inst34|Dout[0]~reg0  ; 10      ;
; dff89:inst34|Dout[1]~reg0  ; 10      ;
; dff89:inst34|Dout[2]~reg0  ; 10      ;
; add889:inst21|Dout[7]~reg0 ; 8       ;
; add889:inst21|Dout[6]~reg0 ; 8       ;
; add889:inst21|Dout[5]~reg0 ; 8       ;
; add889:inst21|Dout[4]~reg0 ; 8       ;
; add889:inst21|Dout[3]~reg0 ; 8       ;
; add889:inst21|Dout[2]~reg0 ; 8       ;
; add889:inst21|Dout[1]~reg0 ; 7       ;
; add889:inst23|Dout[7]~reg0 ; 6       ;
; add889:inst23|Dout[6]~reg0 ; 6       ;
; add889:inst23|Dout[5]~reg0 ; 6       ;
; add889:inst23|Dout[4]~reg0 ; 6       ;
; add889:inst23|Dout[3]~reg0 ; 6       ;
; add889:inst23|Dout[2]~reg0 ; 6       ;
; add889:inst25|Dout[7]~reg0 ; 6       ;
; add889:inst25|Dout[6]~reg0 ; 6       ;
; add889:inst25|Dout[5]~reg0 ; 6       ;
; add889:inst25|Dout[4]~reg0 ; 6       ;
; add889:inst21|Dout[0]~reg0 ; 6       ;
; add889:inst20|Dout[7]~reg0 ; 6       ;
; add889:inst20|Dout[6]~reg0 ; 6       ;
; add889:inst20|Dout[5]~reg0 ; 6       ;
; add889:inst20|Dout[4]~reg0 ; 6       ;
; add889:inst20|Dout[3]~reg0 ; 6       ;
; add889:inst20|Dout[2]~reg0 ; 6       ;
; add889:inst22|Dout[7]~reg0 ; 6       ;
; add889:inst22|Dout[6]~reg0 ; 6       ;
; add889:inst22|Dout[5]~reg0 ; 6       ;
; add889:inst22|Dout[4]~reg0 ; 6       ;
; add889:inst22|Dout[3]~reg0 ; 6       ;
; add889:inst22|Dout[2]~reg0 ; 6       ;
; add889:inst24|Dout[7]~reg0 ; 6       ;
; add889:inst24|Dout[6]~reg0 ; 6       ;
; add889:inst24|Dout[5]~reg0 ; 6       ;
; add889:inst24|Dout[4]~reg0 ; 6       ;
+----------------------------+---------+


+-----------------------------------------------------+
; Interconnect Usage Summary                          ;
+------------------------------------------------------
; Interconnect Resource Type ; Usage                  ;
+----------------------------+------------------------+
; C4s                        ; 553 / 8,840 ( 6 % )    ;
; Direct links               ; 228 / 11,506 ( 1 % )   ;
; Global clocks              ; 2 / 8 ( 25 % )         ;
; LAB clocks                 ; 40 / 156 ( 25 % )      ;
; LUT chains                 ; 0 / 2,619 ( 0 % )      ;
; Local interconnects        ; 1,114 / 11,506 ( 9 % ) ;
; M4K buffers                ; 0 / 468 ( 0 % )        ;
; R4s                        ; 340 / 7,520 ( 4 % )    ;
+----------------------------+------------------------+


+---------------------------------------------------------------------------+
; LAB Logic Elements                                                        ;
+--------------------------------------------+------------------------------+
; Number of Logic Elements  (Average = 7.72) ; Number of LABs  (Total = 98) ;
+--------------------------------------------+------------------------------+
; 1                                          ; 1                            ;
; 2                                          ; 0                            ;
; 3                                          ; 2                            ;
; 4                                          ; 2                            ;
; 5                                          ; 9                            ;
; 6                                          ; 24                           ;
; 7                                          ; 9                            ;
; 8                                          ; 8                            ;
; 9                                          ; 4                            ;
; 10                                         ; 39                           ;
+--------------------------------------------+------------------------------+


+-------------------------------------------------------------------+
; LAB-wide Signals                                                  ;
+------------------------------------+------------------------------+
; LAB-wide Signals  (Average = 1.17) ; Number of LABs  (Total = 98) ;
+------------------------------------+------------------------------+
; 1 Async. clear                     ; 39                           ;
; 1 Clock                            ; 62                           ;
; 1 Sync. load                       ; 14                           ;
+------------------------------------+------------------------------+


+----------------------------------------------------------------------------+
; LAB Signals Sourced                                                        ;
+---------------------------------------------+------------------------------+
; Number of Signals Sourced  (Average = 7.54) ; Number of LABs  (Total = 98) ;
+---------------------------------------------+------------------------------+
; 0                                           ; 1                            ;
; 1                                           ; 1                            ;
; 2                                           ; 1                            ;
; 3                                           ; 2                            ;
; 4                                           ; 2                            ;
; 5                                           ; 10                           ;
; 6                                           ; 24                           ;
; 7                                           ; 8                            ;

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