📄 fir.fit.rpt
字号:
; Logic cells in carry chains ; 589 ;
; User inserted logic cells ; 0 ;
; I/O pins ; 18 / 65 ( 27 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 2 ;
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; Global clocks ; 2 / 8 ( 25 % ) ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 435 ;
; Total fan-out ; 2784 ;
; Average fan-out ; 3.58 ;
+-----------------------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Din[0] ; 28 ; 4 ; 6 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[1] ; 39 ; 4 ; 16 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[2] ; 34 ; 4 ; 8 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[3] ; 36 ; 4 ; 10 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[4] ; 38 ; 4 ; 16 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[5] ; 35 ; 4 ; 8 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[6] ; 40 ; 4 ; 18 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[7] ; 37 ; 4 ; 12 ; 0 ; 2 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; clear ; 66 ; 3 ; 27 ; 8 ; 3 ; 152 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; clk ; 10 ; 1 ; 0 ; 8 ; 2 ; 435 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; Turbo Bit ; I/O Standard ; Current Strength ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
; Dout[0] ; 86 ; 2 ; 18 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[1] ; 87 ; 2 ; 16 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[2] ; 84 ; 2 ; 20 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[3] ; 89 ; 2 ; 12 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[4] ; 88 ; 2 ; 16 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[5] ; 90 ; 2 ; 10 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[6] ; 78 ; 2 ; 22 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
; Dout[7] ; 85 ; 2 ; 20 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; no ; LVTTL ; 24mA ; Off ; Fitter ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+------------------------------------------------------------
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 3 / 14 ( 21 % ) ; 3.3V ; -- ;
; 2 ; 8 / 17 ( 47 % ) ; 3.3V ; -- ;
; 3 ; 1 / 17 ( 5 % ) ; 3.3V ; -- ;
; 4 ; 8 / 17 ( 47 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+-----------------------------------------------------------------------------------------+
; All Package Pins ;
+------------------------------------------------------------------------------------------
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; I/O Standard ; Voltage ; I/O Type ;
+----------+------------+----------+----------------+--------------+---------+------------+
; 1 ; 0 ; 1 ; GND* ; ; ; Row I/O ;
; 2 ; 1 ; 1 ; GND* ; ; ; Row I/O ;
; 3 ; 2 ; 1 ; GND* ; ; ; Row I/O ;
; 4 ; 4 ; 1 ; GND* ; ; ; Row I/O ;
; 5 ; 8 ; 1 ; GND* ; ; ; Row I/O ;
; 6 ; 9 ; 1 ; *~nCSO~ / GND* ; LVTTL ; ; Row I/O ;
; 7 ; 10 ; 1 ; ^DATA0 ; ; ; -- ;
; 8 ; 11 ; 1 ; ^nCONFIG ; ; ; -- ;
; 9 ; ; 1 ; VCCA_PLL1 ; ; 1.5V ; -- ;
; 10 ; 12 ; 1 ; clk ; LVTTL ; ; Row I/O ;
; 11 ; ; 1 ; GNDA_PLL1 ; ; ; -- ;
; 12 ; 14 ; 1 ; ^nCEO ; ; ; -- ;
; 13 ; 15 ; 1 ; ^nCE ; ; ; -- ;
; 14 ; 16 ; 1 ; ^MSEL0 ; ; ; -- ;
; 15 ; 17 ; 1 ; ^MSEL1 ; ; ; -- ;
; 16 ; 18 ; 1 ; ^DCLK ; ; ; -- ;
; 17 ; 19 ; 1 ; *~ASDO~ / GND* ; LVTTL ; ; Row I/O ;
; 18 ; ; 1 ; VCCIO1 ; ; 3.3V ; -- ;
; 19 ; ; 1 ; GND ; ; ; -- ;
; 20 ; 23 ; 1 ; GND* ; ; ; Row I/O ;
; 21 ; 24 ; 1 ; GND* ; ; ; Row I/O ;
; 22 ; 25 ; 1 ; GND* ; ; ; Row I/O ;
; 23 ; 26 ; 1 ; GND* ; ; ; Row I/O ;
; 24 ; 27 ; 1 ; GND* ; ; ; Row I/O ;
; 25 ; 28 ; 1 ; GND* ; ; ; Row I/O ;
; 26 ; 29 ; 4 ; GND* ; ; ; Column I/O ;
; 27 ; 30 ; 4 ; GND* ; ; ; Column I/O ;
; 28 ; 33 ; 4 ; Din[0] ; LVTTL ; ; Column I/O ;
; 29 ; 34 ; 4 ; GND* ; ; ; Column I/O ;
; 30 ; ; 1 ; GND ; ; ; -- ;
; 31 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ;
; 32 ; ; 1 ; GND ; ; ; -- ;
; 33 ; ; ; VCCINT ; ; 1.5V ; -- ;
; 34 ; 35 ; 4 ; Din[2] ; LVTTL ; ; Column I/O ;
; 35 ; 36 ; 4 ; Din[5] ; LVTTL ; ; Column I/O ;
; 36 ; 39 ; 4 ; Din[3] ; LVTTL ; ; Column I/O ;
; 37 ; 40 ; 4 ; Din[7] ; LVTTL ; ; Column I/O ;
; 38 ; 44 ; 4 ; Din[4] ; LVTTL ; ; Column I/O ;
; 39 ; 45 ; 4 ; Din[1] ; LVTTL ; ; Column I/O ;
; 40 ; 46 ; 4 ; Din[6] ; LVTTL ; ; Column I/O ;
; 41 ; 49 ; 4 ; GND* ; ; ; Column I/O ;
; 42 ; 50 ; 4 ; GND* ; ; ; Column I/O ;
; 43 ; ; 1 ; GND ; ; ; -- ;
; 44 ; ; ; VCCINT ; ; 1.5V ; -- ;
; 45 ; ; 1 ; GND ; ; ; -- ;
; 46 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ;
; 47 ; 51 ; 4 ; GND* ; ; ; Column I/O ;
; 48 ; 52 ; 4 ; GND* ; ; ; Column I/O ;
; 49 ; 55 ; 4 ; GND* ; ; ; Column I/O ;
; 50 ; 56 ; 4 ; GND* ; ; ; Column I/O ;
; 51 ; 57 ; 3 ; GND* ; ; ; Row I/O ;
; 52 ; 58 ; 3 ; GND* ; ; ; Row I/O ;
; 53 ; 59 ; 3 ; GND* ; ; ; Row I/O ;
; 54 ; 60 ; 3 ; GND* ; ; ; Row I/O ;
; 55 ; 61 ; 3 ; GND* ; ; ; Row I/O ;
; 56 ; 62 ; 3 ; GND* ; ; ; Row I/O ;
; 57 ; 63 ; 3 ; GND* ; ; ; Row I/O ;
; 58 ; ; 1 ; GND ; ; ; -- ;
; 59 ; ; 3 ; VCCIO3 ; ; 3.3V ; -- ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; -- ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; -- ;
; 62 ; 70 ; 3 ; #TCK ; ; ; -- ;
; 63 ; 71 ; 3 ; #TMS ; ; ; -- ;
; 64 ; 72 ; 3 ; #TDO ; ; ; -- ;
; 65 ; 73 ; 3 ; GND* ; ; ; Row I/O ;
; 66 ; 75 ; 3 ; clear ; LVTTL ; ; Row I/O ;
; 67 ; 77 ; 3 ; #TDI ; ; ; -- ;
; 68 ; 78 ; 3 ; GND* ; ; ; Row I/O ;
; 69 ; 79 ; 3 ; GND* ; ; ; Row I/O ;
; 70 ; 80 ; 3 ; GND* ; ; ; Row I/O ;
; 71 ; 81 ; 3 ; GND* ; ; ; Row I/O ;
; 72 ; 82 ; 3 ; GND* ; ; ; Row I/O ;
; 73 ; 84 ; 3 ; GND* ; ; ; Row I/O ;
; 74 ; 87 ; 3 ; GND* ; ; ; Row I/O ;
; 75 ; 88 ; 3 ; GND* ; ; ; Row I/O ;
; 76 ; 89 ; 2 ; GND* ; ; ; Column I/O ;
; 77 ; 90 ; 2 ; GND* ; ; ; Column I/O ;
; 78 ; 93 ; 2 ; Dout[6] ; LVTTL ; ; Column I/O ;
; 79 ; 94 ; 2 ; GND* ; ; ; Column I/O ;
; 80 ; ; 2 ; VCCIO2 ; ; 3.3V ; -- ;
; 81 ; ; 1 ; GND ; ; ; -- ;
; 82 ; ; ; VCCINT ; ; 1.5V ; -- ;
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