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来自「FPGA和VHDL的全过程和源码」· NET 代码 · 共 133 行

[
D1
LED-0
LED0



]
[
D2
LED-0
LED0



]
[
D3
LED-0
LED0



]
[
D4
LED-0
LED0



]
[
D5
LED-0
LED0



]
[
D6
LED-0
LED0



]
[
D7
LED-0
LED0



]
[
D8
LED-0
LED0



]
[
P1
HDR2X25
Bank1



]
[
R1
AXIAL-0.4
Res2



]
(
PIN19
D8-2
P1-17
)
(
PIN17
D7-2
P1-15
)
(
PIN15
D6-2
P1-13
)
(
PIN13
D5-2
P1-11
)
(
PIN11
D4-2
P1-9
)
(
PIN7
D3-2
P1-7
)
(
PIN5
D2-2
P1-5
)
(
PIN3
D1-2
P1-3
)
(
NetD1_1
D1-1
D2-1
D3-1
D4-1
D5-1
D6-1
D7-1
D8-1
R1-1
)