📄 dds.fit.rpt
字号:
; 82 ; GND ; ;
; 83 ; GND* ; ;
; 84 ; VCC_IO ; ;
; 85 ; GND* ; ;
; 86 ; GND* ; ;
; 87 ; GND* ; ;
; 88 ; GND* ; ;
; 89 ; GND* ; ;
; 90 ; GND* ; ;
; 91 ; VCC_INT ; ;
; 92 ; GND* ; ;
; 93 ; GND* ; ;
; 94 ; Q[3] ; LVTTL/LVCMOS ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; GND* ; ;
; 98 ; VCC_IO ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; GND* ; ;
; 103 ; GND* ; ;
; 104 ; GND* ; ;
; 105 ; ^nCONFIG ; ;
; 106 ; VCC_INT ; ;
; 107 ; ^MSEL1 ; ;
; 108 ; ^MSEL0 ; ;
; 109 ; GND ; ;
; 110 ; VCC_IO ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; K[2] ; LVTTL/LVCMOS ;
; 114 ; K[3] ; LVTTL/LVCMOS ;
; 115 ; K[4] ; LVTTL/LVCMOS ;
; 116 ; K[5] ; LVTTL/LVCMOS ;
; 117 ; GND ; ;
; 118 ; VCC_IO ; ;
; 119 ; K[6] ; LVTTL/LVCMOS ;
; 120 ; K[7] ; LVTTL/LVCMOS ;
; 121 ; K[8] ; LVTTL/LVCMOS ;
; 122 ; K[9] ; LVTTL/LVCMOS ;
; 123 ; GND ; ;
; 124 ; VCC_INT ; ;
; 125 ; GND* ; ;
; 126 ; GND* ; ;
; 127 ; GND* ; ;
; 128 ; GND* ; ;
; 129 ; GND ; ;
; 130 ; VCC_INT ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; GND* ; ;
; 135 ; GND* ; ;
; 136 ; Q[6] ; LVTTL/LVCMOS ;
; 137 ; GND ; ;
; 138 ; VCC_IO ; ;
; 139 ; GND* ; ;
; 140 ; Q[7] ; LVTTL/LVCMOS ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; GND* ; ;
; 145 ; GND ; ;
; 146 ; VCC_IO ; ;
; 147 ; GND* ; ;
; 148 ; GND* ; ;
; 149 ; GND* ; ;
; 150 ; GND* ; ;
; 151 ; GND ; ;
; 152 ; VCC_INT ; ;
; 153 ; #TDI ; ;
; 154 ; ^nCE ; ;
; 155 ; ^DCLK ; ;
; 156 ; ^DATA0 ; ;
; 157 ; GND* ; ;
; 158 ; GND* ; ;
; 159 ; GND* ; ;
; 160 ; GND* ; ;
; 161 ; GND* ; ;
; 162 ; GND* ; ;
; 163 ; GND* ; ;
; 164 ; GND* ; ;
; 165 ; VCC_IO ; ;
; 166 ; GND* ; ;
; 167 ; GND* ; ;
; 168 ; GND* ; ;
; 169 ; GND* ; ;
; 170 ; GND* ; ;
; 171 ; GND ; ;
; 172 ; GND* ; ;
; 173 ; GND* ; ;
; 174 ; GND* ; ;
; 175 ; GND* ; ;
; 176 ; GND* ; ;
; 177 ; GND* ; ;
; 178 ; VCC_IO ; ;
; 179 ; GND* ; ;
; 180 ; GND* ; ;
; 181 ; GND ; ;
; 182 ; CLK ; LVTTL/LVCMOS ;
; 183 ; GND+ ; ;
; 184 ; GND+ ; ;
; 185 ; VCC_INT ; ;
; 186 ; GND* ; ;
; 187 ; GND* ; ;
; 188 ; GND ; ;
; 189 ; GND* ; ;
; 190 ; GND* ; ;
; 191 ; GND* ; ;
; 192 ; GND* ; ;
; 193 ; GND* ; ;
; 194 ; VCC_IO ; ;
; 195 ; GND* ; ;
; 196 ; GND* ; ;
; 197 ; GND* ; ;
; 198 ; GND* ; ;
; 199 ; GND* ; ;
; 200 ; GND* ; ;
; 201 ; VCC_INT ; ;
; 202 ; GND* ; ;
; 203 ; GND* ; ;
; 204 ; GND* ; ;
; 205 ; GND* ; ;
; 206 ; GND* ; ;
; 207 ; GND* ; ;
; 208 ; GND* ; ;
+-------+------------+--------------+
+-------------------------------------------------------+
; Control Signals ;
+-------+-------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+-------+-------+---------+--------------+--------------+
; CLK ; 182 ; 36 ; Clock ; Pin ;
; RESET ; 8 ; 10 ; Async. clear ; Non-global ;
; EN ; 7 ; 10 ; Clock enable ; Non-global ;
+-------+-------+---------+--------------+--------------+
+---------------------------------+
; Global & Other Fast Signals ;
+------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+------+-------+---------+--------+
; CLK ; 182 ; 36 ; yes ;
+------+-------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 0 ;
; 8 ; 0 ;
; 9 ; 0 ;
; 10 ; 1 ;
+--------------------+------------------------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 1 ;
+--------+-------+
+----------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+------------------------------------------------------------------------------+---------+
; REG1:U1|Q[2]~94 ; 18 ;
; REG1:U1|Q[3]~93 ; 17 ;
; REG1:U1|Q[1]~95 ; 16 ;
; REG1:U1|Q[0]~96 ; 16 ;
; REG1:U1|Q[4]~97 ; 10 ;
; RESET ; 10 ;
; EN ; 10 ;
; ROM:U2|reduce_or~903 ; 6 ;
; REG1:U1|Q[5]~88 ; 6 ;
; ROM:U2|reduce_or~909 ; 5 ;
; ROM:U2|OUTP[6]~7 ; 3 ;
; ROM:U2|reduce_or~902 ; 3 ;
; REG1:U1|Q[9]~89 ; 3 ;
; SUM99:U0|TEMP[9]~39 ; 2 ;
; SUM99:U0|TEMP[5]~38 ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[4] ; 2 ;
; ROM:U2|reduce_or~925 ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[0] ; 2 ;
; SUM99:U0|TEMP[7]~42 ; 2 ;
; SUM99:U0|TEMP[3]~43 ; 2 ;
; SUM99:U0|TEMP[2]~44 ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[1] ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[2] ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[7] ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[3] ; 2 ;
; REG1:U1|Q[8]~91 ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[8] ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[6] ; 2 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|a_csnbuffer:result_node|cout[5] ; 2 ;
; REG1:U1|Q[7]~92 ; 2 ;
; REG1:U1|Q[6]~90 ; 2 ;
; SUM99:U0|TEMP[4]~47 ; 2 ;
; SUM99:U0|TEMP[6]~40 ; 2 ;
; SUM99:U0|TEMP[1]~45 ; 2 ;
; SUM99:U0|TEMP[0]~46 ; 2 ;
; SUM99:U0|TEMP[8]~41 ; 2 ;
; ROM:U2|reduce_or~922 ; 2 ;
; ROM:U2|reduce_or~916 ; 1 ;
; ROM:U2|reduce_or~920 ; 1 ;
; SUM99:U0|lpm_add_sub:add_rtl_0|addcore:adder|unreg_res_node[9]~29 ; 1 ;
; ROM:U2|reduce_or~905 ; 1 ;
; ROM:U2|reduce_or~907 ; 1 ;
; REG2:U3|Q[5]~12 ; 1 ;
; K[3] ; 1 ;
; ROM:U2|OUTP[1]~2 ; 1 ;
; ROM:U2|OUTP[2]~3 ; 1 ;
; ROM:U2|reduce_or~912 ; 1 ;
; ROM:U2|reduce_or~927 ; 1 ;
; ROM:U2|OUTP[0]~1 ; 1 ;
; ROM:U2|reduce_or~929 ; 1 ;
+------------------------------------------------------------------------------+---------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 606 ;
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