📄 phase_shift_sin.fit.rpt
字号:
; 103 ; 83 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 104 ; 84 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 105 ; 85 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 106 ; 86 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 107 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 108 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 109 ; 89 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 110 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 111 ; 91 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 112 ; 92 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 113 ; 93 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 114 ; 94 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 115 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 116 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 117 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 118 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 119 ; 95 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 120 ; 96 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 121 ; 97 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 122 ; 98 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 123 ; 99 ; 2 ; clk ; input ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 124 ; 100 ; 2 ; pout[0] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 125 ; 101 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 126 ; 102 ; 2 ; pout[1] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 127 ; 103 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 128 ; 104 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 129 ; 105 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 130 ; 106 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 131 ; 107 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 132 ; 108 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 133 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 134 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 135 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 136 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 137 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 138 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 139 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 140 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 141 ; 113 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 142 ; 114 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 143 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 144 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |phase_shift_sin ; 529 (20) ; 406 ; 8192 ; 33 ; 0 ; 123 (0) ; 141 (0) ; 265 (20) ; 84 (20) ; 16 (2) ; |phase_shift_sin ;
; |sin_rom:u3| ; 55 (0) ; 34 ; 2048 ; 0 ; 0 ; 21 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u3 ;
; |altsyncram:altsyncram_component| ; 55 (0) ; 34 ; 2048 ; 0 ; 0 ; 21 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u3|altsyncram:altsyncram_component ;
; |altsyncram_66u:auto_generated| ; 55 (0) ; 34 ; 2048 ; 0 ; 0 ; 21 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u3|altsyncram:altsyncram_component|altsyncram_66u:auto_generated ;
; |altsyncram_4r92:altsyncram1| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u3|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|altsyncram_4r92:altsyncram1 ;
; |sld_mod_ram_rom:mgl_prim2| ; 55 (39) ; 34 ; 0 ; 0 ; 0 ; 21 (13) ; 2 (2) ; 32 (24) ; 12 (12) ; 0 (0) ; |phase_shift_sin|sin_rom:u3|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|sld_mod_ram_rom:mgl_prim2 ;
; |sld_rom_sr:\ram_rom_logic_gen:no_name_gen:info_rom_sr| ; 16 (16) ; 8 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u3|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:no_name_gen:info_rom_sr ;
; |sin_rom:u4| ; 53 (0) ; 34 ; 2048 ; 0 ; 0 ; 19 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u4 ;
; |altsyncram:altsyncram_component| ; 53 (0) ; 34 ; 2048 ; 0 ; 0 ; 19 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u4|altsyncram:altsyncram_component ;
; |altsyncram_66u:auto_generated| ; 53 (0) ; 34 ; 2048 ; 0 ; 0 ; 19 (0) ; 2 (0) ; 32 (0) ; 12 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u4|altsyncram:altsyncram_component|altsyncram_66u:auto_generated ;
; |altsyncram_4r92:altsyncram1| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u4|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|altsyncram_4r92:altsyncram1 ;
; |sld_mod_ram_rom:mgl_prim2| ; 53 (38) ; 34 ; 0 ; 0 ; 0 ; 19 (12) ; 2 (2) ; 32 (24) ; 12 (12) ; 0 (0) ; |phase_shift_sin|sin_rom:u4|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|sld_mod_ram_rom:mgl_prim2 ;
; |sld_rom_sr:\ram_rom_logic_gen:no_name_gen:info_rom_sr| ; 15 (15) ; 8 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; |phase_shift_sin|sin_rom:u4|altsyncram:altsyncram_component|altsyncram_66u:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:no_name_gen:info_rom_sr ;
; |sld_hub:sld_hub_inst| ; 149 (41) ; 96 ; 0 ; 0 ; 0 ; 53 (34) ; 23 (0) ; 73 (7) ; 6 (0) ; 5 (5) ; |phase_shift_sin|sld_hub:sld_hub_inst ;
; |lpm_decode:instruction_decoder| ; 5 (0) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (0) ; 0 (0) ; 0 (0) ; |phase_shift_sin|sld_hub:sld_hub_inst|lpm_decode:instruction_decoder ⌨️ 快捷键说明
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