wed.zsf
来自「基于Quartus II FPGA/CPLD数字系统设计实例(VHDL源代码文件」· ZSF 代码 · 共 3 行
ZSF
3 行
D:/my_eda/yxbianma8_3_1/yxbianma8_3_1.vwf 54100 162300 541 108200 0
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