select_2.hier_info
来自「基于Quartus II FPGA/CPLD数字系统设计实例(VHDL源代码文件」· HIER_INFO 代码 · 共 8 行
HIER_INFO
8 行
|select_2
a => q~0.DATAB
b => q~0.DATAA
s => q~0.OUTPUTSELECT
q <= q~0.DB_MAX_OUTPUT_PORT_TYPE
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