d.sta.summary
来自「基于Quartus II FPGA/CPLD数字系统设计实例(VHDL源代码文件」· SUMMARY 代码 · 共 14 行
SUMMARY
14 行
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TimeQuest Timing Analyzer Summary
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Type : Setup 'cp'
Slack : -0.588
TNS : -0.588
Type : Hold 'cp'
Slack : 1.322
TNS : 0.000
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