📄 up3_clock.tan.rpt
字号:
; N/A ; 139.35 MHz ( period = 7.176 ns ) ; count3[10] ; count3[10] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.915 ns ;
; N/A ; 139.37 MHz ( period = 7.175 ns ) ; BCD_TSEC[1] ; DATA_BUS_VALUE[1] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.119 ns ;
; N/A ; 139.43 MHz ( period = 7.172 ns ) ; count3[10] ; count3[9] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.911 ns ;
; N/A ; 139.47 MHz ( period = 7.170 ns ) ; count3[10] ; count3[12] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.909 ns ;
; N/A ; 139.53 MHz ( period = 7.167 ns ) ; count3[10] ; count3[8] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.906 ns ;
; N/A ; 139.61 MHz ( period = 7.163 ns ) ; count1[12] ; TEMP_BCD_HRD1[3] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.935 ns ;
; N/A ; 139.70 MHz ( period = 7.158 ns ) ; count1[12] ; TEMP_BCD_HRD1[2] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.930 ns ;
; N/A ; 139.74 MHz ( period = 7.156 ns ) ; count3[10] ; count3[14] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.895 ns ;
; N/A ; 139.82 MHz ( period = 7.152 ns ) ; count3[13] ; count3[15] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.891 ns ;
; N/A ; 139.84 MHz ( period = 7.151 ns ) ; count3[13] ; count3[13] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.890 ns ;
; N/A ; 139.84 MHz ( period = 7.151 ns ) ; count3[13] ; count3[11] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.890 ns ;
; N/A ; 139.86 MHz ( period = 7.150 ns ) ; count3[13] ; count3[10] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.889 ns ;
; N/A ; 139.92 MHz ( period = 7.147 ns ) ; count1[4] ; TEMP_BCD_SECD1[1] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.886 ns ;
; N/A ; 139.92 MHz ( period = 7.147 ns ) ; count1[4] ; TEMP_BCD_SECD1[2] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.886 ns ;
; N/A ; 139.92 MHz ( period = 7.147 ns ) ; count1[4] ; TEMP_BCD_SECD1[0] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.886 ns ;
; N/A ; 139.94 MHz ( period = 7.146 ns ) ; count3[13] ; count3[9] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.885 ns ;
; N/A ; 139.98 MHz ( period = 7.144 ns ) ; count3[13] ; count3[12] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.883 ns ;
; N/A ; 140.04 MHz ( period = 7.141 ns ) ; count3[13] ; count3[8] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.880 ns ;
; N/A ; 140.25 MHz ( period = 7.130 ns ) ; count3[13] ; count3[14] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.869 ns ;
; N/A ; 140.31 MHz ( period = 7.127 ns ) ; BCD_TSEC[0] ; BCD_HRD1[3] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 6.867 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+-----------------+---------------------------+------------+-----------+-----------------------------+---------------------------+-------------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'CLK_48MHZ' ;
+------------------------------------------+--------------------+-------------------+------------+-----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+--------------------+-------------------+------------+-----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_HRD1[3] ; DATA_BUS_VALUE[3] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.372 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND0[1] ; DATA_BUS_VALUE[1] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.536 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND0[0] ; DATA_BUS_VALUE[0] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.753 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND1[1] ; DATA_BUS_VALUE[1] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.863 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND0[3] ; DATA_BUS_VALUE[3] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.864 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND1[0] ; DATA_BUS_VALUE[0] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 2.866 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_MIND1[2] ; DATA_BUS_VALUE[2] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 3.192 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_HRD0[2] ; DATA_BUS_VALUE[2] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 3.307 ns ;
; Not operational: Clock Skew > Data Delay ; ALARM_BCD_HRD1[2] ; DATA_BUS_VALUE[2] ; CLK_48MHZ ; CLK_48MHZ ; None ; None ; 3.565 ns ;
+------------------------------------------+--------------------+-------------------+------------+-----------+----------------------------+----------------------------+--------------------------+
+----------------------------------------------------------------------------------+
; tsu ;
+-------+--------------+------------+------------+---------------------+-----------+
; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-------+--------------+------------+------------+---------------------+-----------+
; N/A ; None ; 10.432 ns ; DipSwitch2 ; TEMP_BCD_HRD1[3] ; CLK_48MHZ ;
; N/A ; None ; 10.427 ns ; DipSwitch2 ; TEMP_BCD_HRD1[2] ; CLK_48MHZ ;
; N/A ; None ; 9.995 ns ; DipSwitch2 ; TEMP_BCD_HRD1[1] ; CLK_48MHZ ;
; N/A ; None ; 9.936 ns ; DipSwitch2 ; ALARM_BCD_MIND0[3] ; CLK_48MHZ ;
; N/A ; None ; 9.936 ns ; DipSwitch2 ; ALARM_BCD_MIND0[2] ; CLK_48MHZ ;
; N/A ; None ; 9.717 ns ; DipSwitch2 ; TEMP_BCD_HRD1[0] ; CLK_48MHZ ;
; N/A ; None ; 9.294 ns ; DipSwitch2 ; TEMP_BCD_MIND1[2] ; CLK_48MHZ ;
; N/A ; None ; 9.294 ns ; DipSwitch2 ; TEMP_BCD_MIND1[1] ; CLK_48MHZ ;
; N/A ; None ; 9.264 ns ; DipSwitch2 ; TEMP_BCD_SECD0[0] ; CLK_48MHZ ;
; N/A ; None ; 9.264 ns ; DipSwitch2 ; TEMP_BCD_SECD0[3] ; CLK_48MHZ ;
; N/A ; None ; 9.264 ns ; DipSwitch2 ; TEMP_BCD_SECD0[1] ; CLK_48MHZ ;
; N/A ; None ; 9.264 ns ; DipSwitch2 ; TEMP_BCD_SECD0[2] ; CLK_48MHZ ;
; N/A ; None ; 9.189 ns ; DipSwitch2 ; ALARM_BCD_MIND0[1] ; CLK_48MHZ ;
; N/A ; None ; 9.189 ns ; DipSwitch2 ; ALARM_BCD_MIND0[0] ; CLK_48MHZ ;
; N/A ; None ; 8.826 ns ; DipSwitch2 ; TEMP_BCD_HRD0[0] ; CLK_48MHZ ;
; N/A ; None ; 8.826 ns ; DipSwitch2 ; TEMP_BCD_HRD0[2] ; CLK_48MHZ ;
; N/A ; None ; 8.826 ns ; DipSwitch2 ; TEMP_BCD_HRD0[3] ; CLK_48MHZ ;
; N/A ; None ; 8.826 ns ; DipSwitch2 ; TEMP_BCD_HRD0[1] ; CLK_48MHZ ;
; N/A ; None ; 8.768 ns ; DipSwitch2 ; ALARM_BCD_MIND1[1] ; CLK_48MHZ ;
; N/A ; None ; 8.768 ns ; DipSwitch2 ; ALARM_BCD_MIND1[2] ; CLK_48MHZ ;
; N/A ; None ; 8.768 ns ; Dip⌨️ 快捷键说明
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