majority_voter.fit.summary

来自「Verylog编写的　Quartus II平台的简单设计实例　附仿真波形」· SUMMARY 代码 · 共 10 行

SUMMARY
10 行
字号 
Fitter Status : Successful - Mon May 19 20:35:29 2008
Quartus II Version : 6.0 Build 178 04/27/2006 SJ Full Version
Revision Name : MAJORITY_VOTER
Top-level Entity Name : MAJORITY_VOTER
Family : MAX7000S
Device : EPM7128SLC84-15
Timing Models : Final
Total macrocells : 2 / 128 ( 2 % )
Total pins : 9 / 68 ( 13 % )

majority_voter.fit.summary - 源码说明

本页面展示了「Verylog编写的　Quartus II平台的简单设计实例　附仿真波形」中的 majority_voter.fit.summary 源码文件，采用 SUMMARY 编程语言编写，共 10 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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