📄 part4.sim.rpt
字号:
; |part4|LEDG[7] ; |part4|LEDG[7] ; padio ;
; |part4|HEX0[0] ; |part4|HEX0[0] ; padio ;
; |part4|HEX0[1] ; |part4|HEX0[1] ; padio ;
; |part4|HEX0[2] ; |part4|HEX0[2] ; padio ;
; |part4|HEX0[3] ; |part4|HEX0[3] ; padio ;
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; |part4|DATA[2]~feeder ; |part4|DATA[2]~feeder ; combout ;
; |part4|DATA[4]~feeder ; |part4|DATA[4]~feeder ; combout ;
; |part4|ADDR[0]~feeder ; |part4|ADDR[0]~feeder ; combout ;
; |part4|ADDR[1]~feeder ; |part4|ADDR[1]~feeder ; combout ;
; |part4|ADDR[2]~feeder ; |part4|ADDR[2]~feeder ; combout ;
; |part4|ADDR[3]~feeder ; |part4|ADDR[3]~feeder ; combout ;
; |part4|OE_N~feeder ; |part4|OE_N~feeder ; combout ;
+-------------------------------+-------------------------------+------------------+
The following table displays output ports that do not toggle to 0 during simulation.
+----------------------------------------------------------------------------------+
; Missing 0-Value Coverage ;
+-------------------------------+-------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+-------------------------------+-------------------------------+------------------+
; |part4|SEG7_LUT:u6|oSEG[0]~70 ; |part4|SEG7_LUT:u6|oSEG[0]~70 ; combout ;
; |part4|SEG7_LUT:u6|oSEG[1]~71 ; |part4|SEG7_LUT:u6|oSEG[1]~71 ; combout ;
; |part4|SEG7_LUT:u6|oSEG[2]~72 ; |part4|SEG7_LUT:u6|oSEG[2]~72 ; combout ;
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; |part4|OE_N ; |part4|OE_N ; regout ;
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; |part4|DATA[1] ; |part4|DATA[1] ; regout ;
; |part4|DATA[2] ; |part4|DATA[2] ; regout ;
; |part4|DATA[3] ; |part4|DATA[3] ; regout ;
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; |part4|DATA[7] ; |part4|DATA[7] ; regout ;
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; |part4|SW[17] ; |part4|SW[17] ; combout ;
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