📄 halfadder.vhd
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Library ieee ;
use ieee.std_logic_1164.all;
entity hadder is
port (
a : in std_logic;
b : in std_logic;
s : out std_logic;
co : out std_logic
);
end hadder;
architecture hadder_rtl of hadder is
begin
s <= a xor b ;
co <= a and b ;
end hadder_rtl;
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