maxmin.hier_info

一个自己编写的这次2008北京市电子竞赛VHDL源程序

|maxmin
RD <= ADC0820:inst.RD
clk => ADC0820:inst.clk
D[0] => ADC0820:inst.D[0]
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D[2] => ADC0820:inst.D[2]
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D[6] => ADC0820:inst.D[6]
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lovk <= ADC0820:inst.LOCK0
clkk <= calculate:inst2.clkk
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en => display1:inst3.en
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segoutpp[6] <= display1:inst3.segoutpp[6]
segoutpp[7] <= display1:inst3.segoutpp[7]


|maxmin|ADC0820:inst
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clk => i[1].CLK
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D[1] => Q[1]~reg0.DATAIN
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D[3] => Q[3]~reg0.DATAIN
D[4] => Q[4]~reg0.DATAIN
D[5] => Q[5]~reg0.DATAIN
D[6] => Q[6]~reg0.DATAIN
D[7] => Q[7]~reg0.DATAIN
RD <= current_state.st0.DB_MAX_OUTPUT_PORT_TYPE
LOCK0 <= lock.DB_MAX_OUTPUT_PORT_TYPE
Q[0] <= Q[0]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[1] <= Q[1]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[2] <= Q[2]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[3] <= Q[3]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[4] <= Q[4]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[5] <= Q[5]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[6] <= Q[6]~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q[7] <= Q[7]~reg0.DB_MAX_OUTPUT_PORT_TYPE


|maxmin|calculate:inst2
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datamax[6] <= max[6].DB_MAX_OUTPUT_PORT_TYPE
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|maxmin|display1:inst3
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clkin => segmin[3].CLK
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