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📄 main.tan.rpt

📁 VHDL实现的交通灯程序
💻 RPT
📖 第 1 页 / 共 5 页
字号:
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; Timing Analyzer Summary                                                                                                                                                                                             ;
+------------------------------+------------------------------------------+---------------+----------------------------------+-----------------------+-------------------------+------------+----------+--------------+
; Type                         ; Slack                                    ; Required Time ; Actual Time                      ; From                  ; To                      ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+------------------------------------------+---------------+----------------------------------+-----------------------+-------------------------+------------+----------+--------------+
; Worst-case tsu               ; N/A                                      ; None          ; 2.000 ns                         ; key                   ; Debounce:u3|temp1       ;            ; clk      ; 0            ;
; Worst-case tco               ; N/A                                      ; None          ; 37.000 ns                        ; ControlB:u5|temp_h[1] ; num[3]                  ; clk        ;          ; 0            ;
; Worst-case th                ; N/A                                      ; None          ; 6.000 ns                         ; key                   ; Debounce:u3|temp1       ;            ; clk      ; 0            ;
; Worst-case Minimum tco       ; N/A                                      ; None          ; 8.000 ns                         ; StatusSelect:u6|voice ; voice                   ; clk        ;          ; 0            ;
; Clock Setup: 'clk'           ; N/A                                      ; None          ; 31.25 MHz ( period = 32.000 ns ) ; Emergency:u2|temp     ; StatusSelect:u6|temp[1] ; clk        ; clk      ; 0            ;
; Clock Hold: 'clk'            ; Not operational: Clock Skew > Data Delay ; None          ; N/A                              ; Emergency:u2|temp     ; Emergency:u2|temp       ; clk        ; clk      ; 1            ;
; Total number of failed paths ;                                          ;               ;                                  ;                       ;                         ;            ;          ; 1            ;
+------------------------------+------------------------------------------+---------------+----------------------------------+-----------------------+-------------------------+------------+----------+--------------+


+--------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary                                                                                                               ;
+-----------------+--------------------+----------+------------------+----------+-----------------------+---------------------+--------+
; Clock Node Name ; Clock Setting Name ; Type     ; Fmax Requirement ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ;
+-----------------+--------------------+----------+------------------+----------+-----------------------+---------------------+--------+
; clk             ;                    ; User Pin ; NONE             ; NONE     ; N/A                   ; N/A                 ; N/A    ;
+-----------------+--------------------+----------+------------------+----------+-----------------------+---------------------+--------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk'                                                                                                                                                                                                                                                ;
+-----------------------------------------+-----------------------------------------------------+---------------------------+---------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack                                   ; Actual fmax (period)                                ; From                      ; To                        ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+---------------------------+---------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A                                     ; 31.25 MHz ( period = 32.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|temp[1]   ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|temp[0]   ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|temp[2]   ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|voice     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|a         ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[15]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[8]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[6]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[7]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[9]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[10]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[11]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[12]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[16]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[13]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[14]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[17]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[18]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[5]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[4]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[3]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[2]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[1]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 32.26 MHz ( period = 31.000 ns )                    ; Emergency:u2|temp         ; StatusSelect:u6|t[0]      ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 43.48 MHz ( period = 23.000 ns )                    ; Emergency:u2|temp         ; ControlA:u4|temp_l[2]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 43.48 MHz ( period = 23.000 ns )                    ; Emergency:u2|temp         ; ControlA:u4|temp_l[3]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlA:u4|g             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|r             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlA:u4|r             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|g             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|t             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlA:u4|t             ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|temp_h[1]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|temp_h[0]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|temp_h[2]     ; clk        ; clk      ; None                        ; None                      ; None                    ;
; N/A                                     ; 45.45 MHz ( period = 22.000 ns )                    ; Emergency:u2|temp         ; ControlB:u5|temp_l[1]     ; clk        ; clk      ; None                        ; None                      ; None                    ;

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