📄 lcd_success.fit.rpt
字号:
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/Cyclone II ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Always Enable Input Buffers ; Off ; Off ;
+------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/FPGA/VHDL_Lab/lcd_success/lcd_success.pin.
+---------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+-----------------------+
; Resource ; Usage ;
+---------------------------------------------+-----------------------+
; Total logic elements ; 63 / 33,216 ( < 1 % ) ;
; -- Combinational with no register ; 30 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 33 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 34 ;
; -- 3 input functions ; 5 ;
; -- <=2 input functions ; 24 ;
; -- Register only ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 50 ;
; -- arithmetic mode ; 13 ;
; ; ;
; Total registers ; 33 / 33,216 ( < 1 % ) ;
; Total LABs ; 5 / 2,076 ( < 1 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 15 / 475 ( 3 % ) ;
; -- Clock pins ; 1 / 8 ( 13 % ) ;
; Global signals ; 3 ;
; M4Ks ; 0 / 105 ( 0 % ) ;
; Total memory bits ; 0 / 483,840 ( 0 % ) ;
; Total RAM block bits ; 0 / 483,840 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 3 / 16 ( 19 % ) ;
; Maximum fan-out node ; s[2]~clkctrl ;
; Maximum fan-out ; 16 ;
; Highest non-global fan-out signal ; datacnt[0] ;
; Highest non-global fan-out ; 13 ;
; Total fan-out ; 292 ;
; Average fan-out ; 2.50 ;
+---------------------------------------------+-----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Reset ; G26 ; 5 ; 65 ; 27 ; 1 ; 13 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; clk ; N2 ; 2 ; 0 ; 18 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; data[0] ; J1 ; 2 ; 0 ; 26 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[1] ; J2 ; 2 ; 0 ; 26 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[2] ; H1 ; 2 ; 0 ; 27 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[3] ; H2 ; 2 ; 0 ; 27 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[4] ; J4 ; 2 ; 0 ; 27 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[5] ; J3 ; 2 ; 0 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[6] ; H4 ; 2 ; 0 ; 27 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; data[7] ; H3 ; 2 ; 0 ; 28 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; en ; K3 ; 2 ; 0 ; 26 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; lcd_blon ; K2 ; 2 ; 0 ; 25 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; lcd_on ; L4 ; 2 ; 0 ; 25 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rs ; K1 ; 2 ; 0 ; 25 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rw ; K4 ; 2 ; 0 ; 26 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
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