📄 ps2rs232.fit.rpt
字号:
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/Cyclone II ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Always Enable Input Buffers ; Off ; Off ;
+------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/FPGA/xinkaifabanshiyan/zijizuode/ps2rs232/ps2rs232.pin.
+------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+--------------------------------------------------+
; Resource ; Usage ;
+---------------------------------------------+--------------------------------------------------+
; Total logic elements ; 415 / 33,216 ( 1 % ) ;
; -- Combinational with no register ; 234 ;
; -- Register only ; 25 ;
; -- Combinational with a register ; 156 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 212 ;
; -- 3 input functions ; 77 ;
; -- <=2 input functions ; 101 ;
; -- Register only ; 25 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 345 ;
; -- arithmetic mode ; 45 ;
; ; ;
; Total registers ; 181 / 33,216 ( < 1 % ) ;
; Total LABs ; 39 / 2,076 ( 2 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 15 / 322 ( 5 % ) ;
; -- Clock pins ; 1 / 8 ( 13 % ) ;
; Global signals ; 10 ;
; M4Ks ; 0 / 105 ( 0 % ) ;
; Total memory bits ; 0 / 483,840 ( 0 % ) ;
; Total RAM block bits ; 0 / 483,840 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 10 / 16 ( 63 % ) ;
; Maximum fan-out node ; ps2_keyboard_interface:inst1|rx_released~clkctrl ;
; Maximum fan-out ; 98 ;
; Highest non-global fan-out signal ; rst ;
; Highest non-global fan-out ; 43 ;
; Total fan-out ; 1894 ;
; Average fan-out ; 3.06 ;
+---------------------------------------------+--------------------------------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; mclk ; W12 ; 7 ; 33 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; rst ; AA3 ; 8 ; 1 ; 0 ; 3 ; 43 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; rx_read ; AA5 ; 8 ; 3 ; 0 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; rx_ascii[0] ; A20 ; 4 ; 63 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[1] ; A17 ; 4 ; 46 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[2] ; A15 ; 4 ; 42 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[3] ; A11 ; 3 ; 29 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[4] ; B10 ; 3 ; 27 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[5] ; B8 ; 3 ; 16 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[6] ; A5 ; 3 ; 3 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; rx_ascii[7] ; B3 ; 3 ; 1 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; tx_write_ack_o ; E8 ; 3 ; 14 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
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