📄 dds.fit.rpt
字号:
; Auto Packed Registers -- Cyclone ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
+----------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/Documents and Settings/Administrator/桌面/fsk_mc/dds.pin.
+--------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+----------------------------+
; Resource ; Usage ;
+---------------------------------------------+----------------------------+
; Total logic elements ; 45 / 12,060 ( < 1 % ) ;
; -- Combinational with no register ; 4 ;
; -- Register only ; 13 ;
; -- Combinational with a register ; 28 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 5 ;
; -- 3 input functions ; 2 ;
; -- 2 input functions ; 20 ;
; -- 1 input functions ; 9 ;
; -- 0 input functions ; 9 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 29 ;
; -- arithmetic mode ; 16 ;
; -- qfbk mode ; 3 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 17 ;
; -- asynchronous clear/load mode ; 5 ;
; ; ;
; Total LABs ; 11 / 1,206 ( < 1 % ) ;
; Logic elements in carry chains ; 19 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 19 / 173 ( 11 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 3 ;
; M4Ks ; 1 / 52 ( 2 % ) ;
; Total memory bits ; 1,024 / 239,616 ( < 1 % ) ;
; Total RAM block bits ; 4,608 / 239,616 ( 2 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 3 / 8 ( 38 % ) ;
; Maximum fan-out node ; CLK ;
; Maximum fan-out ; 36 ;
; Highest non-global fan-out signal ; fsk_decode:u7|LessThan1~99 ;
; Highest non-global fan-out ; 5 ;
; Total fan-out ; 165 ;
; Average fan-out ; 2.46 ;
+---------------------------------------------+----------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLK ; 28 ; 1 ; 0 ; 15 ; 2 ; 36 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; ls ; 233 ; 2 ; 6 ; 27 ; 0 ; 5 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; count1[0] ; 228 ; 2 ; 8 ; 27 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[1] ; 75 ; 4 ; 10 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[2] ; 67 ; 4 ; 6 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[3] ; 38 ; 1 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[4] ; 44 ; 1 ; 0 ; 6 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[5] ; 39 ; 1 ; 0 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[6] ; 73 ; 4 ; 8 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; count1[7] ; 74 ; 4 ; 8 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; dc_out ; 167 ; 3 ; 53 ; 22 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dds1[0] ; 21 ; 1 ; 0 ; 20 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dds1[1] ; 41 ; 1 ; 0 ; 7 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dds1[2] ; 128 ; 3 ; 53 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dds1[3] ; 132 ; 3 ; 53 ; 4 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; dds1[4] ; 133 ; 3 ; 53 ; 4 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
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