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来自「VHDL硬件描述」· HIER_INFO 代码 · 共 40 行

|Counter60
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Reset => Temp_Q2[2].ACLR
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Out_High <= Out_High~reg0.DB_MAX_OUTPUT_PORT_TYPE
Q1[0] <= Temp_Q1[0].DB_MAX_OUTPUT_PORT_TYPE
Q1[1] <= Temp_Q1[1].DB_MAX_OUTPUT_PORT_TYPE
Q1[2] <= Temp_Q1[2].DB_MAX_OUTPUT_PORT_TYPE
Q1[3] <= Temp_Q1[3].DB_MAX_OUTPUT_PORT_TYPE
Q2[0] <= Temp_Q2[0].DB_MAX_OUTPUT_PORT_TYPE
Q2[1] <= Temp_Q2[1].DB_MAX_OUTPUT_PORT_TYPE
Q2[2] <= Temp_Q2[2].DB_MAX_OUTPUT_PORT_TYPE
Q2[3] <= Temp_Q2[3].DB_MAX_OUTPUT_PORT_TYPE