📄 de2_tv.map.rpt
字号:
; Maximum fan-out ; 500 ;
; Total fan-out ; 9113 ;
; Average fan-out ; 3.20 ;
+---------------------------------------------+---------------------------------------------------------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+--------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name ;
+--------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |DE2_TV ; 1231 (46) ; 1058 (0) ; 54208 ; 18 ; 0 ; 9 ; 426 ; 0 ; |DE2_TV ;
; |AUDIO_DAC:u12| ; 17 (17) ; 14 (14) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|AUDIO_DAC:u12 ;
; |DIV:u5| ; 60 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|DIV:u5 ;
; |lpm_divide:lpm_divide_component| ; 60 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|DIV:u5|lpm_divide:lpm_divide_component ;
; |lpm_divide_d6t:auto_generated| ; 60 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|DIV:u5|lpm_divide:lpm_divide_component|lpm_divide_d6t:auto_generated ;
; |sign_div_unsign_3li:divider| ; 60 (0) ; 10 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|DIV:u5|lpm_divide:lpm_divide_component|lpm_divide_d6t:auto_generated|sign_div_unsign_3li:divider ;
; |alt_u_div_7qg:divider| ; 60 (60) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|DIV:u5|lpm_divide:lpm_divide_component|lpm_divide_d6t:auto_generated|sign_div_unsign_3li:divider|alt_u_div_7qg:divider ;
; |I2C_AV_Config:u1| ; 87 (39) ; 57 (28) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|I2C_AV_Config:u1 ;
; |I2C_Controller:u0| ; 48 (48) ; 29 (29) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|I2C_AV_Config:u1|I2C_Controller:u0 ;
; |altsyncram:Ram0_rtl_0| ; 0 (0) ; 0 (0) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|I2C_AV_Config:u1|altsyncram:Ram0_rtl_0 ;
; |altsyncram_kn21:auto_generated| ; 0 (0) ; 0 (0) ; 1024 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|I2C_AV_Config:u1|altsyncram:Ram0_rtl_0|altsyncram_kn21:auto_generated ;
; |ITU_656_Decoder:u4| ; 49 (49) ; 80 (80) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|ITU_656_Decoder:u4 ;
; |Line_Buffer:u10| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u10 ;
; |altshift_taps:altshift_taps_component| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u10|altshift_taps:altshift_taps_component ;
; |shift_taps_k0r:auto_generated| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u10|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated ;
; |altsyncram_q0c1:altsyncram2| ; 0 (0) ; 0 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u10|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated|altsyncram_q0c1:altsyncram2 ;
; |cntr_hpf:cntr1| ; 15 (15) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u10|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated|cntr_hpf:cntr1 ;
; |Line_Buffer:u11| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u11 ;
; |altshift_taps:altshift_taps_component| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u11|altshift_taps:altshift_taps_component ;
; |shift_taps_k0r:auto_generated| ; 15 (0) ; 10 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u11|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated ;
; |altsyncram_q0c1:altsyncram2| ; 0 (0) ; 0 (0) ; 10208 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u11|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated|altsyncram_q0c1:altsyncram2 ;
; |cntr_hpf:cntr1| ; 15 (15) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Line_Buffer:u11|altshift_taps:altshift_taps_component|shift_taps_k0r:auto_generated|cntr_hpf:cntr1 ;
; |Reset_Delay:u3| ; 33 (33) ; 25 (25) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Reset_Delay:u3 ;
; |SEG7_LUT_8:u0| ; 31 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0 ;
; |SEG7_LUT:u0| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0|SEG7_LUT:u0 ;
; |SEG7_LUT:u1| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0|SEG7_LUT:u1 ;
; |SEG7_LUT:u2| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0|SEG7_LUT:u2 ;
; |SEG7_LUT:u3| ; 7 (7) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0|SEG7_LUT:u3 ;
; |SEG7_LUT:u4| ; 3 (3) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|SEG7_LUT_8:u0|SEG7_LUT:u4 ;
; |Sdram_Control_4Port:u6| ; 508 (173) ; 547 (124) ; 32768 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6 ;
; |Sdram_PLL:sdram_pll1| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_PLL:sdram_pll1 ;
; |altpll:altpll_component| ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_PLL:sdram_pll1|altpll:altpll_component ;
; |Sdram_RD_FIFO:read_fifo1| ; 66 (0) ; 102 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1 ;
; |dcfifo:dcfifo_component| ; 66 (0) ; 102 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component ;
; |dcfifo_fnk1:auto_generated| ; 66 (26) ; 102 (22) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated ;
; |a_gray2bin_kdb:wrptr_g_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_gray2bin_kdb:wrptr_g_gray2bin ;
; |a_gray2bin_kdb:ws_dgrp_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_gray2bin_kdb:ws_dgrp_gray2bin ;
; |a_graycounter_i27:wrptr_gp| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_graycounter_i27:wrptr_gp ;
; |a_graycounter_o96:rdptr_g1p| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_graycounter_o96:rdptr_g1p ;
; |alt_synch_pipe_0e8:ws_dgrp| ; 0 (0) ; 20 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|alt_synch_pipe_0e8:ws_dgrp ;
; |dffpipe_qe9:dffpipe9| ; 0 (0) ; 20 (20) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|alt_synch_pipe_0e8:ws_dgrp|dffpipe_qe9:dffpipe9 ;
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; |dffpipe_pe9:dffpipe6| ; 0 (0) ; 20 (20) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|alt_synch_pipe_vd8:rs_dgwp|dffpipe_pe9:dffpipe6 ;
; |altsyncram_jk61:fifo_ram| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|altsyncram_jk61:fifo_ram ;
; |altsyncram_drg1:altsyncram3| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|altsyncram_jk61:fifo_ram|altsyncram_drg1:altsyncram3 ;
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; |Sdram_RD_FIFO:read_fifo2| ; 66 (0) ; 102 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo2 ;
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; |dcfifo_fnk1:auto_generated| ; 66 (26) ; 102 (22) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated ;
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; |a_graycounter_i27:wrptr_gp| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_RD_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_graycounter_i27:wrptr_gp ;
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; |Sdram_WR_FIFO:write_fifo1| ; 67 (0) ; 102 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1 ;
; |dcfifo:dcfifo_component| ; 67 (0) ; 102 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_component ;
; |dcfifo_fnk1:auto_generated| ; 67 (27) ; 102 (22) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated ;
; |a_gray2bin_kdb:rdptr_g_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_gray2bin_kdb:rdptr_g_gray2bin ;
; |a_gray2bin_kdb:rs_dgwp_gray2bin| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_gray2bin_kdb:rs_dgwp_gray2bin ;
; |a_graycounter_i27:wrptr_gp| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_fnk1:auto_generated|a_graycounter_i27:wrptr_gp ;
; |a_graycounter_o96:rdptr_g1p| ; 11 (11) ; 11 (11) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_TV|Sdram_Control_4Port:u6|Sdram_WR_FIFO:write_fifo1|dcfifo:dcfifo_componen⌨️ 快捷键说明
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