ram_dp.plg
来自「DDR2 的控制器」· PLG 代码 · 共 8 行
PLG
8 行
@P: Worst Slack : -1.531
@P: RAM_DP|WrClock - Estimated Frequency : 153.1 MHz
@P: RAM_DP|WrClock - Requested Frequency : 200.0 MHz
@P: RAM_DP|WrClock - Estimated Period : 6.531
@P: RAM_DP|WrClock - Requested Period : 5.000
@P: RAM_DP|WrClock - Slack : -1.531
@P: CPU Time : 0h:00m:07s
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