📄 deccounter.sim.rpt
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; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~3 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~3 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[3]~1 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[3]~1 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[3] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[3] ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[2] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[2] ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[1] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|datab_node[1] ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[3]~1 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[3]~1 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[2]~2 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[2]~2 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[1]~3 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[1]~3 ; out0 ;
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; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[2] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[2] ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[1] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|unreg_res_node[1] ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~4 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~4 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~5 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~5 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~6 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~6 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~7 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~7 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~8 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~8 ; out0 ;
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; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~10 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~10 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~11 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~11 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~12 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~12 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~13 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~13 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~14 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~14 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~15 ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|_~15 ; out0 ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[3] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[3] ; sout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[2] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[2] ; cout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[2] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[2] ; sout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[1] ; cout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[1] ; sout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[0] ; cout ;
; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |deccounter|CNT4B:inst7|lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; sout ;
+---------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------+------------------+
The following table displays output ports that do not toggle to 0 during simulation.
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Missing 0-Value Coverage ;
+---------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+---------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------+------------------+
; |deccounter|OUT0[3] ; |deccounter|OUT0[3] ; pin_out ;
; |deccounter|OUT0[2] ; |deccounter|OUT0[2] ; pin_out ;
; |deccounter|OUT0[1] ; |deccounter|OUT0[1] ; pin_out ;
; |deccounter|OUT0[0] ; |deccounter|OUT0[0] ; pin_out ;
; |deccounter|OUT1[3] ; |deccounter|OUT1[3] ; pin_out ;
; |deccounter|OUT1[2] ; |deccounter|OUT1[2] ; pin_out ;
; |deccounter|OUT1[1] ; |deccounter|OUT1[1] ; pin_out ;
; |deccounter|OUT1[0] ; |deccounter|OUT1[0] ; pin_out ;
; |deccounter|OUT2[3] ; |deccounter|OUT2[3] ; pin_out ;
; |deccounter|OUT2[2] ; |deccounter|OUT2[2] ; pin_out ;
; |deccounter|OUT2[1] ; |deccounter|OUT2[1] ; pin_out ;
; |deccounter|OUT2[0] ; |deccounter|OUT2[0] ; pin_out ;
; |deccounter|OUT3[3] ; |deccounter|OUT3[3] ; pin_out ;
; |deccounter|OUT3[2] ; |deccounter|OUT3[2] ; pin_out ;
; |deccounter|OUT3[1] ; |deccounter|OUT3[1] ; pin_out ;
; |deccounter|OUT3[0] ; |deccounter|OUT3[0] ; pin_out ;
; |deccounter|CNT4B:inst7|CQI[0] ; |deccounter|CNT4B:inst7|CQI[0] ; regout ;
; |deccounter|CNT4B:inst7|CQI[3] ; |deccounter|CNT4B:inst7|CQI[3] ; regout ;
; |deccounter|CNT4B:inst7|CQI[2] ; |deccounter|CNT4B:inst7|CQI[2] ; regout ;
; |deccounter|CNT4B:inst7|CQI[1] ; |deccounter|CNT4B:inst7|CQI[1] ; regout ;
; |deccounter|REG4B:inst4|DOUT[0] ; |deccounter|REG4B:inst4|DOUT[0] ; regout ;
; |deccounter|REG4B:inst4|DOUT[1] ; |deccounter|REG4B:inst4|DOUT[1] ; regout ;
; |deccounter|REG4B:inst4|DOUT[2] ; |deccounter|REG4B:inst4|DOUT[2] ; regout ;
; |deccounter|REG4B:inst4|DOUT[3] ; |deccounter|REG4B:inst4|DOUT[3] ; regout ;
; |deccounter|CNT4B:inst6|CQI[0] ; |deccounter|CNT4B:inst6|CQI[0] ; regout ;
; |deccounter|CNT4B:inst6|COUT ; |deccounter|CNT4B:inst6|COUT ; out0 ;
; |deccounter|CNT4B:inst6|CQI[3] ; |deccounter|CNT4B:inst6|CQI[3] ; regout ;
; |deccounter|CNT4B:inst6|CQI[2] ; |deccounter|CNT4B:inst6|CQI[2] ; regout ;
; |deccounter|CNT4B:inst6|CQI[1] ; |deccounter|CNT4B:inst6|CQI[1] ; regout ;
; |deccounter|REG4B:inst3|DOUT[0] ; |deccounter|REG4B:inst3|DOUT[0] ; regout ;
; |deccounter|REG4B:inst3|DOUT[1] ; |deccounter|REG4B:inst3|DOUT[1] ; regout ;
; |deccounter|REG4B:inst3|DOUT[2] ; |deccounter|REG4B:inst3|DOUT[2] ; regout ;
; |deccounter|REG4B:inst3|DOUT[3] ; |deccounter|REG4B:inst3|DOUT[3] ; regout ;
; |deccounter|CNT4B:inst5|CQI[0] ; |deccounter|CNT4B:inst5|CQI[0] ; regout ;
; |deccounter|CNT4B:inst5|COUT ; |deccounter|CNT4B:inst5|COUT ; out0 ;
; |deccounter|CNT4B:inst5|CQI[3] ; |deccounter|CNT4B:inst5|CQI[3] ; regout ;
; |deccounter|CNT4B:inst5|CQI[2] ; |deccounter|CNT4B:inst5|CQI[2] ; regout ;
; |deccounter|CNT4B:inst5|CQI[1] ; |deccounter|CNT4B:inst5|CQI[1] ; regout ;
; |deccounter|REG
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