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autoconstraint_state2.sdc

《设计与验证Verilog HDL》光盘内容
SDC
字号:

#Begin clock constraint
define_clock -name {b:state2|clk} -period 1.000 -clockgroup Autoconstr_clkgroup_0 -rise 0.000 -fall 0.500 -route 0.000 
#End clock constraint

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