dled.fit.rpt

使用VerilogHDL语言实现硬件的开发模拟

; Configuration scheme                         ; Passive Serial                          ;
; Reserve all unused pins                      ; As output driving an unspecified signal ;
; Security bit                                 ; Off                                     ;
; Base pin-out file on sameframe device        ; Off                                     ;
+----------------------------------------------+-----------------------------------------+


+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in C:/Documents and Settings/zyy/桌面/Verilog hdl/动态数码显示/dled.fit.eqn.


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/Documents and Settings/zyy/桌面/Verilog hdl/动态数码显示/dled.pin.


+---------------------------------------------------+
; Fitter Resource Usage Summary                     ;
+-------------------------------+-------------------+
; Resource                      ; Usage             ;
+-------------------------------+-------------------+
; Logic cells                   ; 27 / 128 ( 21 % ) ;
; Registers                     ; 15 / 128 ( 11 % ) ;
; Number of pterms used         ; 39                ;
; User inserted logic elements  ; 0                 ;
; I/O pins                      ; 17 / 68 ( 25 % )  ;
;     -- Clock pins             ; 1 / 2 ( 50 % )    ;
;     -- Dedicated input pins   ; 0 / 2 ( 0 % )     ;
; Global signals                ; 1                 ;
; Shareable expanders           ; 0 / 128 ( 0 % )   ;
; Parallel expanders            ; 0 / 120 ( 0 % )   ;
; Cells using turbo bit         ; 27 / 128 ( 21 % ) ;
; Maximum fan-out node          ; clock             ;
; Maximum fan-out               ; 15                ;
; Total fan-out                 ; 165               ;
; Average fan-out               ; 3.75              ;
+-------------------------------+-------------------+


+---------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                  ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name  ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; clock ; 83    ; --       ; --  ; 15                    ; 0                  ; yes    ; no             ; TTL          ; User                 ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                         ;
+--------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name   ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load        ;
+--------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; seg[0] ; 40    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[1] ; 41    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[2] ; 44    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[3] ; 45    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[4] ; 46    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[5] ; 48    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[6] ; 49    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg[7] ; 50    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; sl[0]  ; 51    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; sl[1]  ; 52    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; sl[2]  ; 54    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; sl[3]  ; 55    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
+--------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+


+-------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                      ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir.   ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1        ; 0          ; --       ; GND+           ;        ;              ;         ;                 ;
; 2        ; 1          ; --       ; GND+           ;        ;              ;         ;                 ;
; 3        ; 2          ; --       ; VCCINT         ; power  ;              ; 5.0V    ;                 ;
; 4        ; 3          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 5        ; 4          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 6        ; 5          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 7        ; 6          ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 8        ; 7          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 9        ; 8          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 10       ; 9          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 11       ; 10         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 12       ; 11         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 13       ; 12         ; --       ; VCCIO          ; power  ;              ; 5.0V    ;                 ;
; 14       ; 13         ; --       ; +TDI           ; input  ; TTL          ;         ; N               ;
; 15       ; 14         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 16       ; 15         ; --       ; RESERVED       ;        ;              ;         ;                 ;