📄 mpeg2.fit.rpt
字号:
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 18 ;
; 3 ; 1 ;
+--------+-------+
+-------------------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------------------------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+---------------------------------------------------------------------------------------------------------------+---------+
; CK2M ; 64 ;
; FR8 ; 61 ;
; fifo_r_w:584|48m_kunbang:370|change_det:364|74684:77|41~66 ; 25 ;
; FP8STB ; 23 ;
; audio_delay:666|39~8 ; 22 ;
; 248m-ts-de:632|74298:386|6~0 ; 21 ;
; mux_8m:583|74164:637|3~0 ; 19 ;
; A12 ; 19 ;
; A10 ; 19 ;
; A11 ; 19 ;
; guolu:533|state5~63 ; 19 ;
; mux_8m:583|74164:637|4~1 ; 19 ;
; mux_8m:583|74164:637|5~1 ; 19 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:373|74164:34|6~1 ; 19 ;
; 2m_sel_ch:650|auto_det_ch:3|VD_FLAG~7 ; 18 ;
; guolu:533|state3~16 ; 18 ;
; guolu:533|state4~27 ; 18 ;
; audio_delay:666|delay_counter:61|COUNT_OE~47 ; 18 ;
; 722~36 ; 17 ;
; D0 ; 17 ;
; audio_delay:666|delay_counter:61|RD_FIFO_OE~462 ; 17 ;
; CK4M ; 13 ;
; fifo_r_w:584|48m_kunbang:370|ck4567ts:365|CH3_DCLK~38 ; 13 ;
; fifo_r_w:584|48m_kunbang:370|ck4567ts:365|CH2_DCLK~47 ; 13 ;
; audio_delay:666|delay_counter:61|lpm_counter:COUNT_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[13]~COUT ; 13 ;
; audio_delay:666|delay_counter:61|lpm_counter:COUNT_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[10]~COUT ; 13 ;
; fifo_r_w:584|48m_kunbang:370|ck4567ts:365|FP8O~$wirecell ; 12 ;
; fifo_r_w:584|48m_kunbang:370|w_r_en:368|49~9 ; 12 ;
; 718~43 ; 12 ;
; WR/ ; 11 ;
; RSTL ; 11 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:373|74162:125|43~35 ; 10 ;
; mux_8m:583|74273:705|15~1 ; 10 ;
; yima:621|2-4yima:103|9~58 ; 10 ;
; mux_8m:583|74273:705|19~2 ; 10 ;
; fifo_r_w:584|48m_fifo_wr:371|8count:74|f8count:sub|247 ; 10 ;
; audio_delay:666|delay_counter:61|lpm_counter:COUNT_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[11]~COUT ; 10 ;
; fifo_r_w:584|48m_kunbang:370|w_r_en:368|21mux:75|5~58 ; 10 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:370|74162:125|43~35 ; 10 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:373|74162:125|44~35 ; 9 ;
; fifo_r_w:584|48m_fifo_wr:371|8count:74|f8count:sub|246 ; 9 ;
; mux_8m:583|74164:637|9~1 ; 9 ;
; 248m-ts-en:595|74298:357|7~56 ; 9 ;
; 248m-ts-en:595|74298:357|5~56 ; 9 ;
; 248m-ts-en:595|74298:357|8~56 ; 9 ;
; fifo_r_w:584|48m_kunbang:370|cmp_128:366|74164:34|7~1 ; 9 ;
; fifo_r_w:584|48m_kunbang:370|change_det:364|74164:34|8~1 ; 9 ;
; 248m-ts-en:595|74298:357|6~41 ; 9 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:370|74162:125|44~35 ; 9 ;
; fifo_r_w:584|48m_kunbang:370|auto_det_chx:373|74162:125|45~35 ; 8 ;
+---------------------------------------------------------------------------------------------------------------+---------+
+------------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+---------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+---------+---------------+-----------------+---------------------------+----------+
; yima:621|140~90 ; LC1_C12 ; Output enable ; no ; yes ; +ve ;
+-------------------+---------+---------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 32 ;
; 1 ; 11 ;
; 2 ; 7 ;
; 3 ; 9 ;
; 4 ; 0 ;
; 5 ; 9 ;
; 6 ; 11 ;
; 7 ; 13 ;
; 8 ; 52 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 57 ;
; 1 ; 18 ;
; 2 ; 9 ;
; 3 ; 12 ;
; 4 ; 13 ;
; 5 ; 12 ;
; 6 ; 15 ;
; 7 ; 7 ;
; 8 ; 1 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 - 1 ; 36 ;
; 2 - 3 ; 28 ;
; 4 - 5 ; 17 ;
; 6 - 7 ; 21 ;
; 8 - 9 ; 20 ;
; 10 - 11 ; 12 ;
; 12 - 13 ; 2 ;
; 14 - 15 ; 4 ;
; 16 - 17 ; 3 ;
; 18 - 19 ; 1 ;
+----------------------------+----------------+
+------------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+---------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+---------------------+-----------------------------+------------------------------+
; A ; 40 / 96 ( 42 % ) ; 10 / 48 ( 21 % ) ; 37 / 48 ( 77 % ) ;
; B ; 30 / 96 ( 31 % ) ; 13 / 48 ( 27 % ) ; 13 / 48 ( 27 % ) ;
; C ; 40 / 96 ( 42 % ) ; 13 / 48 ( 27 % ) ; 16 / 48 ( 33 % ) ;
; D ; 50 / 96 ( 52 % ) ; 35 / 48 ( 73 % ) ; 40 / 48 ( 83 % ) ;
; E ; 16 / 96 ( 17 % ) ; 16 / 48 ( 33 % ) ; 14 / 48 ( 29 % ) ;
; F ; 54 / 96 ( 56 % ) ; 40 / 48 ( 83 % ) ; 25 / 48 ( 52 % ) ;
; Total ; 230 / 576 ( 40 % ) ; 127 / 288 ( 44 % ) ; 145 / 288 ( 50 % ) ;
+-------+---------------------+-----------------------------+------------------------------+
+-----------------------------+
; LAB Column Interconnect ;
+-------+---------------------+
; Col. ; Interconnect Used ;
+-------+---------------------+
; 1 ; 4 / 24 ( 17 % ) ;
; 2 ; 9 / 24 ( 38 % ) ;
; 3 ; 9 / 24 ( 38 % ) ;
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