makeheader

来自「將Verilog設計轉成VHDL設計的程式」· 代码 · 共 2 行

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2 行

echo -e "#ifndef $1_H \r\n#define $1_H \r\n\r\n#endif" > $1.hecho -e "#include \"$1.h\"" > $1.cpp

makeheader - 源码说明

本页面展示了「將Verilog設計轉成VHDL設計的程式」中的 makeheader 源码文件，采用编程语言编写，共 2 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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